參數(shù)資料
型號： S3S12XF512J0VLH
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, QFP64
封裝： LQFP-64
文件頁數(shù)： 1047/1306頁
文件大?。?/td> 8007K
代理商： S3S12XF512J0VLH
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Chapter 16 S12X Debug (S12XDBGV3) Module
MC9S12XF - Family Reference Manual, Rev.1.19
Freescale Semiconductor
765
16.3.2.3
Debug Trace Control Register (DBGTCR)
Read: Anytime
Write: Bits 7:6 only when S12XDBG is neither secure nor armed.
Bits 5:0 anytime the module is disarmed.
Address: 0x0022
76543210
R
TSOURCE
TRANGE
TRCMOD
TALIGN
W
Reset
0
00000
Figure 16-5. Debug Trace Control Register (DBGTCR)
Table 16-9. DBGTCR Field Descriptions
Field
Description
7–6
TSOURCE
Trace Source Control Bits — The TSOURCE bits select the data source for the tracing session. If the MCU
system is secured, these bits cannot be set and tracing is inhibited. See Table 16-10.
5–4
TRANGE
Trace Range Bits — The TRANGE bits allow ltering of trace information from a selected address range when
tracing from the CPU12X in Detail Mode. The XGATE tracing range cannot be narrowed using these bits. To use
a comparator for range ltering, the corresponding COMPE and SRC bits must remain cleared. If the COMPE
bit is not clear then the comparator will also be used to generate state sequence triggers. If the corresponding
SRC bit is set the comparator is mapped to the XGATE buses, the TRANGE bits have no effect on the valid
address range, memory accesses within the whole memory map are traced. See Table 16-11.
3–2
TRCMOD
Trace Mode Bits — See Section 16.4.5.2 for detailed Trace Mode descriptions. In Normal Mode, change of ow
information is stored. In Loop1 Mode, change of ow information is stored but redundant entries into trace
memory are inhibited. In Detail Mode, address and data for all memory and register accesses is stored. See
1–0
TALIGN
Trigger Align Bits — These bits control whether the trigger is aligned to the beginning, end or the middle of a
tracing session. See Table 16-13.
Table 16-10. TSOURCE — Trace Source Bit Encoding
TSOURCE
Tracing Source
00
No tracing requested
01
CPU12X
10(1)
1. No range limitations are allowed. Thus tracing operates as if TRANGE = 00.
XGATE
111,(2)
2. No Detail Mode tracing supported. If TRCMOD = 10, no information is stored.
Both CPU12X and XGATE
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PDF描述
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