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參數(shù)資料
| 型號： | S1C60N08F0A0100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, QFP-100 |
| 文件頁數(shù)： | 89/145頁 |
| 文件大?。?/td> | 1118K |
| 代理商： | S1C60N08F0A0100 |
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I-36
EPSON
S1C60N08 TECHNICAL HARDWARE
CHAPTER 4: PERIPHERAL CIRCUITS AND OPERATION (Serial Interface)
(3) Serial data input/output permutation
The S1C60N08 Series allows the input/output permutation of serial data to be selected by mask
option as to either LSB first or MSB first. The block diagram showing input/output permutation in
case of LSB first and MSB first is provided in Figure 4.7.3.1.
SD7 SD6 SD5 SD4
Address [2F1H]
In case of LSB first
SIN
SOUT
SD3 SD2 SD1 SD0
Address [2F0H]
Output
latch
SD0 SD1 SD2 SD3
Address [2F0H]
In case of MSB first
SIN
SOUT
SD4 SD5 SD6 SD7
Address [2F1H]
Output
latch
Fig. 4.7.3.1 Serial data input/output permutation
(4) SIOF signal
When the serial interface is used in the slave mode (external clock mode), SIOF is used to indicate
whether the internal serial interface is available to transmit or receive data for the master side (exter-
nal) serial device. SIOF signal is generated from output port R11 by mask option.
SIOF signal becomes "1" (high) when the S1C60N08 serial interface becomes available to transmit or
receive data; normally, it is at "0" (low).
SIOF signal changes from "0" to "1" immediately after "1" is written to SCTRG and returns from "1" to
"0" when eight synchronous clock has been counted.
(5) Timing chart
The serial interface timing chart is shown in Figure 4.7.3.2.
SCTRG
SCLK
SIN
8-bit shift register
SOUT
ISIO
SIOF
SCTRG
SCLK
SIN
8-bit shift register
SOUT
ISIO
SIOF
(a) SE2 = "1"
(b) SE2 = "0"
Fig. 4.7.3.2 Serial interface timing chart
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