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參數(shù)資料
| 型號： | S1C60N08F0A0100 |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, QFP-100 |
| 文件頁數(shù)： | 75/145頁 |
| 文件大小： | 1118K |
| 代理商： | S1C60N08F0A0100 |
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S1C60N08 TECHNICAL HARDWARE
EPSON
I-23
CHAPTER 4: PERIPHERAL CIRCUITS AND OPERATION (Input Ports)
Data
bus
K
Address
Interrupt factor
flag (IK2)
Noise
rejector
Address
Interrupt mask
register (EIK)
Interrupt request
Mask option
(K20–K23)
Fig. 4.4.2.3 Input interrupt circuit configuration (K20–K23)
There is no input comparison register for K20–K23, and interrupt is fixed to occur at th rising edge of
input. The interrupt mask can be selected for each of the four terminals with the interrupt mask register
(EIK20–EIK23). When all the enabled terminals are "0", interrupt occurs when one or more of the ports
changed to "1".
When an interrupt occurs, the interrupt factor flag (IK2) is set to "1".
Figure 4.4.2.4 shows an example of an interrupt being generated for K20–K23.
Interrupt mask register
EIK23
0
EIK22
1
EIK21
1
EIK20
1
Input port
(1)
(Initial value)
Interrupt generation
K23
0
K22
0
K21
0
K20
0
With the above setting, the interrupt of K20–K23 is generated under the following condition:
(2)
K23
1
K22
0
K21
0
K20
0
(3)
K23
1
K22
0
K21
1
K20
0
(4)
K23
1
K22
0
K21
1
K20
1
Because K23 interrupt is masked, interrupt will be
generated when one or more terminals among the 3 bits
K20–K22 become "1" from a state where all terminals
were "0".
Fig. 4.4.2.4 Example of interrupt of K20–K23
The mask register (EIK23) masks the interrupt of K23, so an interrupt does not occur at (2). At (3), K21
becomes "1", so that an interrupt occurs if the interrupt enabled terminals were all "0" and at least one
terminal then changes to "1".
At (4), the conditions for interrupt are not established, so an interrupt does not occur.
Futher, terminals that have been masked for interrupt do not affect the conditions for interrupt genera-
tion.
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