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參數(shù)資料
| 型號： | MT90520AG |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA456 |
| 封裝： | 35 X 35 MM, 1.27 MM PITCH, PLASTIC, MS-034, BGA-456 |
| 文件頁數(shù)： | 94/180頁 |
| 文件大小： | 1736K |
| 代理商： | MT90520AG |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁當(dāng)前第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁
MT90520
Data Sheet
94
Zarlink Semiconductor Inc.
Section 4.7.2.2, “Synchronous Clocking Circuit” may be sourced from the internal PLL clock or the TDM input clock
for any DS1/E1 port of the device.
Figure 34 - Interface to TDM Bus Module and Common Clock Generation Circuitry
Note1:
Shaded sections of figure above indicate circuitry outlined elsewhere in this document.
Note2:
The SDT/UDT interface is replicated on a per-port basis. The backplane interface and common clock generation circuitry are only implemented once
per device.
TDM
Bus
Module
STiCLK
SToCLK
LOS
MCLK/2
CLKSEL
Digital PLL
4:1
Mux
8 kHz Network Mode
SRTS Mode
Line Clocking Mode
Adaptive Mode
common TDM rate clock
SDT/UDT Interface (one
per port)
PLL_INPUT_SEL
4:1
Mux
PLLCLK
External
PLL
TDM_CLK
2:1
Mux
2:1
Mux
P
. . .
P
S
PRI_REF
SLV/MSTR
EXT/INT
S
Backplane
Interface and
Common Clock
Generation (one
per device)
C4M_C2M_
out
C4M_C2M_
in
C4M/C2M
F0
2:1
Mux
F0_in
F0_MODE<2>
SLV/MSTR
/512 or /256
Convert to
External
Format
F0_out
F0_MODE
<1:0>
16:2
Mux
P
S
相關(guān)PDF資料 |
PDF描述 |
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