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參數(shù)資料
| 型號： | MT90520AG |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA456 |
| 封裝： | 35 X 35 MM, 1.27 MM PITCH, PLASTIC, MS-034, BGA-456 |
| 文件頁數(shù)： | 146/180頁 |
| 文件大?。?/td> | 1736K |
| 代理商： | MT90520AG |
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MT90520
Data Sheet
146
Zarlink Semiconductor Inc.
6.2.10 External Memory Interface Module
Address: 620A + p*10 (Hex)
Label: TDM6_Pp (where p represents the port number)
Reset Value: 0000 (Hex)
Label
Bit
Position
Type
Description
PERM_
UNDERRUN_
REPORT
15:0
R/O/L
Permanent Underrun Report. (Applies only to SDT mode.)
This register represents bits<15:0> of the 32-bit permanent underrun reports. Bit<15>
corresponds to channel 15, bit<14> corresponds to channel 14, etc.
When an underrun occurs on a certain channel, the corresponding bit is set high; the
microprocessor can clear these bits by writing them to ‘0’.
Table 87 - TDM Control Register 6 (one per port)
Address: 7000 (Hex)
Label: MACR
Reset Value: 0000 (Hex)
Label
Bit
Position
Type
Description
MCFG
2:0
R/W
Memory Configuration:
“000” = No external memory
“100” = Bank of 1 M words (max. 1 bank)
“101” = Banks of 512 K words (max. 2 banks)
“110” = Banks of 256 K words (max. 4 banks)
“111” = Banks of 128 K words (max. 4 banks)
All others = Reserved.
MTYP
3
R/W
Memory Type:
‘0’ = Flow-through
‘1’ = Pipelined.
PESE
4
R/W
Parity Error Service Enable.
When this bit is set and either the LPPRTY_E bit or the HBPRTY_E bit is asserted at
7004h, the XMEMA_SRV bit is set in the Main Status Register at 0002h.
Reserved
15:5
R/O
Always reads “0000_0000_000”.
Table 88 - Memory Arbiter Configuration Register
Address: 7004 (Hex)
Label: PERS
Reset Value: 0000 (Hex)
Label
Bit
Position
Type
Description
LBPRTY_E
0
R/O/L
Low Byte Parity Error.
If set, this bit indicates that a parity error has occurred in the lower 8 bits of the data word
being read from external memory. A parity error may occur if a location in memory is read
before being written. Writing ‘0’ to this bit clears it.
Table 89 - Parity Error Status Register
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參數(shù)描述 |
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