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參數(shù)資料
| 型號： | MT90520AG |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | 8-Port Primary Rate Circuit Emulation AAL1 SAR |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PBGA456 |
| 封裝： | 35 X 35 MM, 1.27 MM PITCH, PLASTIC, MS-034, BGA-456 |
| 文件頁數(shù)： | 144/180頁 |
| 文件大?。?/td> | 1736K |
| 代理商： | MT90520AG |
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MT90520
Data Sheet
144
Zarlink Semiconductor Inc.
Address: 6202 + p*10 (Hex)
Label: TDM2_Pp (where p represents the port number)
Reset Value: 0000 (Hex)
Label
Bit
Position
Type
Description
TDM_SEGMEN_
BASE_ADD
8:0
R/W
Segmentation Circular Buffer Base Address. (Applies only to SDT mode.)
Represents bits<19:11> of the SDT Segmentation Circular Buffer
word
address in
external memory.
Reserved
12:9
R/O
Always reads “0000”.
TDM_SEGMEN_
PORT_CONTROL
13
R/W
Segmentation TDM Port Control.
‘0’ = Port is not active (data is not transferred from the TDM module to the rest of the
MT90520).
‘1’ = Port is active.
TDM_SEGMEN_
INT_ENB
14
R/W
Segmentation Internal Enable Process.
‘0’ = Process is disabled.
‘1’ = Process that writes data/CAS to the TDM input buffer is enabled.
TDM_SEGMEN_
EXT_ENB
15
R/W
Segmentation External Enable Process. (Applies only to SDT mode.)
‘0’ = Process is disabled.
‘1’ = Process that transfers data from the input buffer to external memory is enabled.
Table 83 - TDM Control Register 2 (one per port)
Address: 6204 + p*10 (Hex)
Label: TDM3_Pp (where p represents the port number)
Reset Value: 0000 (Hex)
Label
Bit
Position
Type
Description
TDM_REASS_
BASE_ADD
4:0
R/W
SDT Reassembly Circular Buffer Base Address. (Applies only to SDT mode.)
Represents bits<19:15> of the SDT Reassembly Circular Buffer
word
address in external
memory.
Reserved
9:5
R/O
Always reads “00_000”.
REPLAY_
N_SILENCE
10
R/W
Play old data or silence byte on underrun. (Applies only to SDT mode.)
‘0’ = During a TDM underrun, the reassembly process outputs silence bytes (programmed
in the MAINTDM1 register at 6000h) on DSTo.
‘1’ = During a TDM underrun, the reassembly process replays the reassembly circular
buffer.
TDM_REASS_
CLK_POL
11
R/W
Reassembly TDM Output Clock Polarity.
‘0’ = TDM data is driven out on the falling edge of SToCLK or C4M_C2M
‘1’ = TDM data is driven out on the rising edge of SToCLK or C4M_C2M.
In ST-BUS, this bit must be set to “0”
TDM_REASS_
LOS
12
R/W
Outgoing Loss of Signal. (Applies only to UDT mode.)
CSTo/LOSo pin drives out the value programmed in this field.
TDM_REASS_
PORT_CONTROL
13
R/W
Reassembly TDM port control.
‘0’ = Port is not active (output data pins are held in high impedance).
‘1’ = Port is active.
TDM_REASS_
INT_ENB
14
R/W
Reassembly Internal Enable Process.
‘0’ = Process is disabled.
‘1’ = Process that transfers data/CAS from the TDM output buffer to the output pins is
enabled.
TDM_REASS_
EXT_ENB
15
R/W
Reassembly External Enable Process. (Applies only to SDT mode.)
‘0’ = Process is disabled.
‘1’ = Process that transfers data/CAS from external memory to the TDM output buffer is
enabled.
Table 84 - TDM Control Register 3 (one per port)
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