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參數(shù)資料
| 型號： | CL-PS7500FE |
| 廠商： | CIRRUS LOGIC INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | System-on-a Chip for Internet Appliance |
| 中文描述： | 32-BIT, RISC MICROCONTROLLER, PQFP240 |
| 封裝： | PLASTIC, QFP-240 |
| 文件頁數(shù)： | 40/251頁 |
| 文件大?。?/td> | 2367K |
| 代理商： | CL-PS7500FE |
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June 1997
39
ADVANCE DATA BOOK v2.0
ARM PROCESSOR MMU
CL-PS7500FE
System-on-a-Chip for Internet Appliance
Figure 6-1. MMU Register Summary
6.1.1
Translation Table Base Register
The Translation Table Base register contains the physical address of the base of the translation table
maintained in main memory. Note that this base must reside on a 16-Kbyte boundary.
6.1.2
Domain Access Control Register
The Domain Access Control register consists of sixteen 2-bit fields, each defines the access permissions
for one of the sixteen domains (D[15:0]).
NOTE:
The registers not shown are reserved and should not be used.
6.1.3
Fault Status Register
The Fault Status register indicates the domain and type of access being attempted when an abort
occurred. Bits 7:4 specify the accessed of the sixteen domains (D[15:0]) during a fault. Bits 3:1 indicate
the type of access being attempted. The encoding of these bits is different for internal and external faults
(as indicated by bit 0 in the register) and is shown in
Table 6-4 on page 47
. A write to this register flushes
the TLB.
6.1.4
Fault Address Register
The Fault Address register holds the virtual address of the access attempted when a fault occurred. A
write to this register causes the data written to be treated as an address and, if it is found in the TLB, the
entry is marked as invalid. (This operation is known as a TLB ‘purge’.) The Fault Status and Fault Address
registers are only updated for data faults, not for prefetch faults.
6.2
Address Translation
The MMU translates virtual addresses generated by the CPU into physical addresses to access external
memory, and also derives and checks the access permission. Translation information, consisting of both
the address translation data and the access permission data, resides in a translation table located in
physical memory. The MMU provides the logic needed to traverse this translation table, obtain
the translated address, and check the access permission.
DOMAIN ACCESS CONTROL
8
9
0
CONTROL
1
D
P W
A
C
M
TRANSLATION TABLE BASE
0
1
2
3
4
5
6
7
10
11
12
13
14
15
0
0
0
0
DOMAIN
STATUS
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
FLUSH TLB
TLB PURGE ADDRESS
FAULT ADDRESS
REGISTER
1 WRITE
2 WRITE
3 WRITE
5 READ
5 WRITE
6 READ
6 WRITE
FAULT STATUS
S
B
R
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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