參數(shù)資料
型號(hào)： CL-PS7500FE
廠商： CIRRUS LOGIC INC
元件分類： 微控制器/微處理器
英文描述： System-on-a Chip for Internet Appliance
中文描述： 32-BIT, RISC MICROCONTROLLER, PQFP240
封裝： PLASTIC, QFP-240
文件頁(yè)數(shù)： 146/251頁(yè)
文件大?。?/td> 2367K
代理商： CL-PS7500FE
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June 1997
145
ADVANCE DATA BOOK v2.0
THE VIDEO SOUND AND PROGRAMMER’S MODEL
CL-PS7500FE
System-on-a-Chip for Internet Appliance
16.7
Horizontal Cycle Register (HCR): Address 0x80
This register defines the period, in pixels, of the horizontal scan that is, display time + retrace time. This
is a 14-bit register of which the bottom 2 bits must be programmed to ‘0’. If N pixels are required in the
horizontal scan period, then value (N
8) should be programmed into the HCR (N must be a multiple of 4).
16.8
Horizontal Sync Width Register (HSWR): Address 0x81
This register defines the period, in pixels, of the HSYNC pulse. This is a 14-bit register of which the bottom
bit must be programmed to ‘0’. If N pixels are required in the HSYNC pulse, then value (N
8) should be
programmed into the HSWR (N must be a multiple of 2).
16.9
Horizontal Border Start Register (HBSR): Address 0x82
This register defines the time, in pixels, from the start of the HSYNC pulse to the start of the border display.
This is a 14-bit register of which the bottom bit must be programmed to ‘0’. If N pixels are required in this
time, then program the value (N
12) into the HBSR (N must be a multiple of 2).
NOTE:
This register must always be programmed, even when a
border is not required. If a
border is not required,
then the value in the HBSR must be set to start the
border in the same place as the display starts (that is,
N
HBSR
= N
HDSR)
.
0 0 0
0
3
4
7
8
11
12
15
16
19
20
21
22
27
28
31
1
2
5
6
9
10
13
14
17
18
23
24
25
26
29
30
X X X X X X
HCR value
0 0 0 0
1
X X X X X
0 0
0 0 0
0
3
4
7
8
11
12
15
16
19
20
21
22
27
28
31
1
2
5
6
9
10
13
14
17
18
23
24
25
26
29
30
X X X X X X X
HSWR value
0 0 0
1
X X X X X
1
0
0 0 0
0
3
4
7
8
11
12
15
16
19
20
21
22
27
28
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1
2
5
6
9
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25
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30
X X X X X X X
HBSR value
0 0
0
1
X X X X X
1
0
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