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參數(shù)資料
| 型號(hào)： | CL-PS7500FE |
| 廠商： | CIRRUS LOGIC INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | System-on-a Chip for Internet Appliance |
| 中文描述： | 32-BIT, RISC MICROCONTROLLER, PQFP240 |
| 封裝： | PLASTIC, QFP-240 |
| 文件頁(yè)數(shù)： | 20/251頁(yè) |
| 文件大小： | 2367K |
| 代理商： | CL-PS7500FE |
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June 1997
19
ADVANCE DATA BOOK v2.0
PIN DESCRIPTIONS
CL-PS7500FE
System-on-a-Chip for Internet Appliance
IOP[7:0]
TOD
1
I/O PORT:
This is the 8-bit-wide I/O port. Each bit is directly control-
lable through an CL-PS7500FE register, and can be used as an
interrupt source if required.
ID
TOD
1
ID:
This pin activates a system ID chip. It is forced low during the
power-on reset sequence.
OD[1:0]
TOD
1
OPEN DRAIN 1:0:
These are the two open-drain pins, which (unlike
the IOP[7:0] bus) cannot be used to generate interrupts, but can be
used as general-purpose I/O pins (for example to communicate with
a realtime clock chip).
SETCS
IC
This signal selects between two address decoding options for the
three main I/O chip selects. It affects the outputs nEASCS, nMSCS,
and nSIOCS2.
nINT1
IT
This is a falling-edge-triggered interrupt. The nINT1 value can be
read directly in the IOCR I/O control register.
INT2
IT
This is a rising-edge-triggered interrupt pin that can generate an
IRQ interrupt.
nINT3
IT
This is an active-low interrupt that can generate an IRQ interrupt.
nINT4
IT
This is an active-low interrupt that can generate an IRQ interrupt.
INT5
IT
This is an active-high interrupt that can generate either an IRQ or a
FIQ interrupt, depending on the status of the relevant mask register
bits.
nINT6
IT
This is an active-low interrupt that can generate either an IRQ or a
FIQ interrupt, depending on the programming of the mask registers.
INT7
IT
This is an active-high interrupt that can generate an IRQ interrupt.
nINT8
IT
This is an active-low interrupt that can generate either a FIQ or an
IRQ interrupt.
INT9
IT
This is an active-high interrupt that can only generate a FIQ (highest
priority) interrupt.
nEVENT1
IT
This is the active-low asynchronous event pin 1. A falling edge ter-
minates the STOP or SUSPEND power-saving modes.
nEVENT2
IT
This is the active-low asynchronous event pin 2. A falling edge ter-
minates the STOP or SUSPEND power-saving modes.
2.1
CL-PS7500FE Pin Descriptions
(cont.)
Name
Type
Drive
Strength
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CL-SH8665 | Integrated ATA Drive microcontroller(集成ATA驅(qū)動(dòng)微控制器) |
| CL1431 | Precision Adjustable Shunt Reference |
| CL1431D | Precision Adjustable Shunt Reference |
| CL1431LP | Precision Adjustable Shunt Reference |
| CL1431S | Precision Adjustable Shunt Reference |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CLPT-12SP-06 | 制造商:Tri-Star Electronics International 功能描述:CONNECTOR - Bulk |
| CLPT-12SP-67 | 制造商:Tri-Star Electronics International 功能描述:- Bulk |
| CL-PU/O | 制造商:Maxell 功能描述:Couleur® Stereo Ear Buds w/ Multi-Size Ear Tips - Purple/Orange |
| CL-PX0070-30QC-A | 制造商:Cirrus Logic 功能描述:TRAY OF 19 3 OF THEM SLIGHTLY BENT LEADS |
| CL-PX0072-30QC-A | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Non-VGA Video Controller |
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