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參數(shù)資料
| 型號： | CL-PS7500FE |
| 廠商： | CIRRUS LOGIC INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | System-on-a Chip for Internet Appliance |
| 中文描述： | 32-BIT, RISC MICROCONTROLLER, PQFP240 |
| 封裝： | PLASTIC, QFP-240 |
| 文件頁數(shù)： | 149/251頁 |
| 文件大小： | 2367K |
| 代理商： | CL-PS7500FE |
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ADVANCE DATA BOOK v2.0
June 1997
148
THE VIDEO SOUND AND PROGRAMMER’S MODEL
CL-PS7500FE
System-on-a-Chip for Internet Appliance
16.17 Vertical Sync Width Register (VSWR): Address 0x91
the VSYNC pulse, then program the value (N
2) into the VSWR. The minimum value allowed for N is 2.
16.18 Vertical Border Start Register (VBSR): Address 0x92
This 13-bit register defines the time, in units of a raster, from the start of the VSYNC pulse to the start of
the
border display. If N rasters are required in this time, then program the value (N
1) into the VBSR. If
no
border is required, this register must still be programmed, in this case to the same value as the VDSR.
16.19 Vertical Display Start Register (VDSR): Address 0x93
This 13-bit register defines the time, in units of a raster, from the start of the VSYNC pulse to the start of
the video display. If N rasters are required in this time, then program the value (N
1) into the VDSR.
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PDF描述 |
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