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參數(shù)資料
| 型號(hào)： | CL-PS7500FE |
| 廠商： | CIRRUS LOGIC INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | System-on-a Chip for Internet Appliance |
| 中文描述： | 32-BIT, RISC MICROCONTROLLER, PQFP240 |
| 封裝： | PLASTIC, QFP-240 |
| 文件頁(yè)數(shù)： | 18/251頁(yè) |
| 文件大?。?/td> | 2367K |
| 代理商： | CL-PS7500FE |
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June 1997
17
ADVANCE DATA BOOK v2.0
PIN DESCRIPTIONS
CL-PS7500FE
System-on-a-Chip for Internet Appliance
VIREF
IA
VIDEO REFERENCE CURRENT:
The video DACs need a refer-
ence current to calibrate them. A constant current source is recom-
mended, although a resistor up to V
DD
is sufficient for many
applications. This current also generates the constant source for the
A-to-D comparators.
VSYNC
OCZ
3
VERTICAL SYNCHRONIZATION:
Dependent on the state of bits
19 and 18 in the external register, either a vertical or a composite
(XNOR) sync can be output on this pin, in either polarity. The width
of the
VSYNC
pulse can be defined in units of a raster.
WS
OCZ
2
WORD SELECT:
This signal denotes whether the output serial data
is for the left-hand or right-hand stereo channel.
nTEST
IT
TEST MODE INPUT:
This pin should be held permanently high. It
is only intended to be used during production test of the
CL-PS7500FE. An on-chip pull-up resistor is included, but it is
advised to apply an external pull-up resistor to this pin.
nWE
OCZ
2
WRITE ENABLE:
This is a active-low signal.
RA[11:0]
OCZ
2
DRAM ROW/COLUMN MULTIPLEXED ADDRESS BUS:
Addresses for this bus are decoded from the ARM processor
address for normal memory accesses, and are generated by the
DMA controller for DMA.
nRAS[3:0]
OCZ
3
DRAM ROW ADDRESS STROBES:
Each of these selects one of
the four banks of DRAM available.
nCAS[3:0]
OCZ
3
DRAM COLUMN ADDRESS STROBES:
These select the byte
within the word for DRAM accesses.
ATOD[3:0]
IAOD
ANALOG-TO-DIGITAL:
These are the four A-to-D channel input
voltages.
ATODREF
IA
ANALOG-TO-DIGITAL REFERENCE:
This is the reference voltage
for the A-to-D converter comparators.
OSCPOWER
OCZ
1
OCILLATOR POWER:
This is the enable signal for the system oscil-
lator(s). When low, this signal can be used to disable the external
oscillator(s).
OSCDELAY
CSOD
1
OCILLATOR DELAY:
This signal requires an RC network to gener-
ate a fixed delay when restarting the system oscillator(s) on exit
from STOP mode.
2.1
CL-PS7500FE Pin Descriptions
(cont.)
Name
Type
Drive
Strength
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CL-SH8665 | Integrated ATA Drive microcontroller(集成ATA驅(qū)動(dòng)微控制器) |
| CL1431 | Precision Adjustable Shunt Reference |
| CL1431D | Precision Adjustable Shunt Reference |
| CL1431LP | Precision Adjustable Shunt Reference |
| CL1431S | Precision Adjustable Shunt Reference |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CLPT-12SP-06 | 制造商:Tri-Star Electronics International 功能描述:CONNECTOR - Bulk |
| CLPT-12SP-67 | 制造商:Tri-Star Electronics International 功能描述:- Bulk |
| CL-PU/O | 制造商:Maxell 功能描述:Couleur® Stereo Ear Buds w/ Multi-Size Ear Tips - Purple/Orange |
| CL-PX0070-30QC-A | 制造商:Cirrus Logic 功能描述:TRAY OF 19 3 OF THEM SLIGHTLY BENT LEADS |
| CL-PX0072-30QC-A | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Non-VGA Video Controller |
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