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參數(shù)資料
| 型號： | CL-PS7500FE |
| 廠商： | CIRRUS LOGIC INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | System-on-a Chip for Internet Appliance |
| 中文描述： | 32-BIT, RISC MICROCONTROLLER, PQFP240 |
| 封裝： | PLASTIC, QFP-240 |
| 文件頁數(shù)： | 229/251頁 |
| 文件大小： | 2367K |
| 代理商： | CL-PS7500FE |
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ADVANCE DATA BOOK v2.0
June 1997
228
CL-PS7500FE
System-on-a-Chip for Internet Appliance
Immediately after the table, the CL-PS7500FE is in 32-bit mode. The eight locations, from address 20 to
3C, must be programmed with eight half-words in the lower sixteen bits of each location. These form the
four required 32-bit instructions when read in pairs by the CL-PS7500FE. The upper 16 bits of each loca-
tion are ignored by the CL-PS7500FE while still in 16-bit mode.
The four instructions program ROMCR0 into 32-bit mode and cause program execution to jump back to
the reset vector at physical address zero. This now be executes correctly. The MOV PC – #0 instruction,
that actually causes execution to jump back to zero, mustbe prefetched in 16-bit mode even though it
occurs after the ROMCR0 is reprogrammed.
Table A-2
shows the data required at memory locations 0x20
to 0x3C to implement this scheme.
The boot code above is a general example to set the ROM interface to use the slowest access timing This
ensures it works with all systems. To speed execution, program the ROM control registers with the fastest
parameters of the interface. On power up, the default state of the CLKCTL register is for the CPUCLK,
MEMCLK, and I_OCLK external clock inputs to be divided by 2. If appropriate, program these clocks to
divide-by-1. This also speeds execution.
3.
Other Methods
The above method is an example of how the CL-PS7500FE can be booted from a system using 32-bit-
wide ROM. There are other methods to do this that may be more appropriate for the required application.
The main advantage of the above method is that it allows the exception vector table to reside at physical
address 0. If this is not a requirement the instructions that reprogram ROMCR0 can reside from location
0 up, and the vector table can be mapped into DRAM by the operating system software.
Table A-2.
Instructions for Programming the ROM Register
Data
Address
Instruction
Notes
0x0000B632
20
0x0000E3A0
24
MOV R11, 0x03200000
Point at register base.
0x00000000
28
0x0000E3A0
2C
MOV R0, #&0
32b, slow, 218.75
μ
s, no burst.
0x00000080
30
0x0000E5CB
34
STRB R0, [R11,0x80]
Program ROMCR0 and switch mode.
0x0000F000
38
0x0000E3A0
3C
MOV PC, #0
Jump to zero.
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