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參數(shù)資料
| 型號： | OR4E14 |
| 廠商： | Lineage Power |
| 英文描述： | Field-Programmable Gate Arrays(現(xiàn)場可編程門陣列) |
| 中文描述： | 現(xiàn)場可編程門陣列（現(xiàn)場可編程門陣列） |
| 文件頁數(shù)： | 82/132頁 |
| 文件大小： | 2667K |
| 代理商： | OR4E14 |
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82
Lucent Technologies Inc.
Preliminary Data Sheet
August 2000
ORCA Series 4 FPGAs
Ball
Bank
Pad
Function
Pair*
Differential
N3
P1
P3
R2
T2
R1
T1
R3
E4
E2
U2
R4
U4
U1
U3
V2
W2
V1
V3
W1
W4
Y2
W3
Y1
Y4
AA2
AA1
AB1
AB2
AC2
AA3
CL
CL
CL
CL
CL
CL
CL
CL
TL
TL
CL
CL
CL
CL
CL
CL
CL
CL
CL
CL
CL
CL
BL
BL
BL
BL
BL
BL
BL
BL
BL
PL25C
PL25D
PL26C
PL26D
PL28C
PL28D
PL29C
PL29D
PL2C
PL2D
PL30C
PL30D
PL32C
PL32D
PL34C
PL34D
PL35C
PL35D
PL36C
PL36D
PL37C
PL37D
PL38C
PL38D
PL39C
PL39D
PL40C
PL42C
PL42D
PL44C
PL44D
A9
A10
VREF
A8
L8T_D1
L8C_D1
L9T_D0
L9C_D0
L10T_D0
L10C_D0
L11T_D1
L11C_D1
L12T_A1
L12C_A1
L12T_D1
L12C_D1
L13T_A2
L13C_A2
L14T_D1
L14C_D1
L15T_D0
L15C_D0
L16T_D1
L16C_D1
L17T_D1
L17C_D1
L1T_D1
L1C_D1
L2T_D1
L2C_D1
—
L3T_A0
L3C_A0
L4T_D1
L4C_D1
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
TRUE
COMPLEMENT
PLCK1T/SCKB
PLCK1C
A7
VREF
PLL_CK0T
PLL_CK0C
A5
A6
VREF
WR/MPI_RW
VREF
A4
A2
A3
A0
A1
DP1
DP0
VREF
D8
D10
D9
VREF
D12
D11
D13
VREF
—
TRUE
COMPLEMENT
TRUE
COMPLEMENT
Pin Information
(continued)
Table 44. OR4E6 352-Pin PBGA Pinout
(continued)
* Differential pairs and physical locations are numbered within each bank (e.g., L19C_A0 is ninteenth pair in an associated bank). The C indi-
cates complementary differential whereas a T indicates true differential. The _A0 indicates the physical location is adjacent balls in either hor-
zontal/vertical direction. Other physical indicators are as follows:
_A1 indicates one ball between pairs.
_A2 indicates two balls between pairs.
_D0 indicates balls are diagonally adjacent.
_D1 indicates diagonally adjacent separated by one physical ball.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| OR4E2-1BC432 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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