參數(shù)資料
型號(hào)： MC68EC060RC50
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 64/128頁(yè)
文件大小： 0K
描述： IC MPU 32BIT 50MHZ 206-PGA
標(biāo)準(zhǔn)包裝： 10
系列： M680x0
處理器類型： M680x0 32-位
速度： 50MHz
電壓： 3.3V
安裝類型： 通孔
封裝/外殼： 206-BEPGA
供應(yīng)商設(shè)備封裝： 206-PGA（47.25x47.25）
包裝： 托盤
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)當(dāng)前第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)
Introduction
1-16
M68060 USER’S MANUAL
MOTOROLA
Table 1-3. Instruction Set Summary
Opcode
Operation
Syntax
ABCD
BCD Source + BCD Destination + X Destination
ABCD Dy,Dx
ABCD –(Ay),–(Ax)
ADD
Source + Destination Destination
ADD <ea>,Dn
ADD Dn,<ea>
ADDA
Source + Destination Destination
ADDA <ea>,An
ADDI
Immediate Data + Destination Destination
ADDI #<data>,<ea>
ADDQ
Immediate Data + Destination Destination
ADDQ #<data>,<ea>
ADDX
Source + Destination + X Destination
ADDX Dy,Dx
ADDX –(Ay),–(Ax)
AND
Source
Λ Destination Destination
AND <ea>,Dn
AND Dn,<ea>
ANDI
Immediate Data
Λ Destination Destination
ANDI #<data>,<ea>
ANDI to CCR Source
Λ CCR CCR
ANDI #<data>,CCR
ANDI to SR
If supervisor state
then Source
Λ SR SR
else TRAP
ANDI #<data>,SR
ASL, ASR
Destination Shifted by count Destination
ASd Dx,Dy
1
ASd #<data>,Dy
ASd <ea>
Bcc
If condition true
then PC + dn PC
Bcc <label>
BCHG
~(bit number of Destination) Z;
~(bit number of Destination) (bit number) of Destination
BCHG Dn,<ea>
BCHG #<data>,<ea>
BCLR
~(bit number of Destination) Z;
0 bit number of Destination
BCLR Dn,<ea>
BCLR #<data>,<ea>
BFCHG
~(bit field of Destination) bit field of Destination
BFCHG <ea>{offset:width}
BFCLR
0 bit field of Destination
BFCLR <ea>{offset:width}
BFEXTS
bit field of Source Dn
BFEXTS <ea>{offset:width},Dn
BFEXTU
bit offset of Source Dn
BFEXTU <ea>{offset:width},Dn
BFFFO
bit offset of Source Bit Scan Dn
BFFFO <ea>{offset:width},Dn
BFINS
Dn bit field of Destination
BFINS Dn,<ea>{offset:width}
BFSET
1s bit field of Destination
BFSET <ea>{offset:width}
BFTST
bit field of Destination
BFTST <ea>{offset:width}
BKPT
Run breakpoint acknowledge cycle;
TRAP as illegal instruction
BKPT #<data>
BRA
PC + dn PC
BRA <label>
BSET
~(bit number of Destination) Z;
1 bit number of Destination
BSET Dn,<ea>
BSET #<data>,<ea>
BSR
SP – 4 SP; PC (SP); PC + dn PC
BSR <label>
BTST
–(bit number of Destination) Z;
BTST Dn,<ea>
BTST #<data>,<ea>
CAS
8
CAS Destination – Compare Operand cc;
if Z, Update Operand Destination
else Destination Compare Operand
CAS Dc,Du,<ea>
CAS2
2
CAS2 Destination 1 – Compare 1 cc;
if Z, Destination 2 – Compare cc;
if Z, Update 1 Destination 1;
Update 2 Destination 2
else Destination 1 Compare 1;
Destination 2 Compare 2
CAS2 Dc1–Dc2,Du1–Du2,(Rn1)–
(Rn2)
CHK
If Dn < 0 or Dn > Source
then TRAP
CHK <ea>,Dn
CHK2
2
If Rn < LB or If Rn > UB
then TRAP
CHK2 <ea>,Rn
CINV
If supervisor state
then invalidate selected cache lines
else TRAP
CINVL <caches>, (An)
CINVP <caches>, (An)
CINVA <caches>
相關(guān)PDF資料
PDF描述
IDT71V65803S133BGG8 IC SRAM 9MBIT 133MHZ 119BGA
MPC8270ZUUPEA IC MPU POWERQUICC II 480-TBGA
IDT71V65803S133BG8 IC SRAM 9MBIT 133MHZ 119BGA
MPC860PCZQ66D4 IC MPU PWRQUICC 66MHZ 357-PBGA
IDT71V65803S100BGG8 IC SRAM 9MBIT 100MHZ 119BGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MC68EC060RC66 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68EC060RC75 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68EC060ZU50 功能描述:IC MPU 68K 50MHZ 304-TBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M680x0 標(biāo)準(zhǔn)包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點(diǎn):- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:783-FCPBGA（29x29） 包裝:托盤
MC68EC060ZU66 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68EC060ZU75 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
發(fā)布緊急采購(gòu)，3分鐘左右您將得到回復(fù)。

采購(gòu)需求

(若只采購(gòu)一條型號(hào)，填寫一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購(gòu)。也可以進(jìn)入我的后臺(tái)，查看報(bào)價(jià)

發(fā)布成功！您可以繼續(xù)發(fā)布采購(gòu)。也可以進(jìn)入我的后臺(tái)，查看報(bào)價(jià)

*型號(hào) *數(shù)量 廠商 批號(hào) 封裝
添加更多采購(gòu)

我的聯(lián)系方式

*
*
*