參數(shù)資料
型號(hào)： DS3105LN+
廠(chǎng)商： Maxim Integrated Products
文件頁(yè)數(shù)： 57/124頁(yè)
文件大?。?/td> 0K
描述： IC TIMING LINE CARD 64-LQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 160
類(lèi)型： 定時(shí)卡 IC，多路復(fù)用器
PLL： 是
主要目的： 以太網(wǎng)，SONET/SDH，Stratum，電信
輸入： CMOS，LVDS，LVPECL，TTL
輸出： CMOS，LVDS，LVPECL，TTL
電路數(shù)： 1
比率 - 輸入:輸出： 5:2
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 312.5MHz
電源電壓： 1.62 V ~ 1.98 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-LQFP（10x10）
包裝： 托盤(pán)
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DS3105
38
Table 7-9. APLL Frequency to Output Frequencies (T0 APLL and T4 APLL)
APLL
FREQUENCY
APLL /
2
APLL /
4
APLL /
5
APLL /
6
APLL /
8
APLL /
10
APLL /
12
APLL /
16
APLL /
20
APLL /
48
APLL /
64
312.500
156.250
—
62.500
—
31.250
—
311.040
155.520
77.760
62.208
51.840
38.880
31.104
25.920
19.440
15.552
6.480
4.860
274.944
137.472
68.376
—
45.824
34.368
—
22.912
17.184
—
5.728
4.296
250.000
125.000
62.500
50.000
—
31.250
25.000
—
12.500
—
178.944
89.472
44.736
—
29.824
22.368
—
14.912
11.184
—
3.728
2.796
160.000
80.000
40.000
32.00
—
20.000
16.000
—
10.000
8.000
—
2.500
148.224
74.112
37.056
—
24.704
18.528
—
12.352
9.264
—
3.088
2.316
131.072
65.536
32.768
—
16.384
—
8.192
—
2.048
122.880
61.440
30.720
24.576
20.480
15.360
12.288
10.240
7.680
6.144
2.560
1.920
104.000
52.000
26.000
20.800
—
13.000
10.400
—
6.500
5.200
—
100.992
50.496
25.248
—
16.832
12.624
—
8.416
6.312
—
2.104
1.578
98.816
49.408
24.704
—
12.352
—
6.176
—
1.544
98.304
49.152
24.576
—
16.384
12.288
—
8.192
6.144
—
2.048
1.536
Note: All frequencies in MHz. Common telecom, datacom, and synchronization frequencies are in bold type.
Table 7-10. T0 APLL Frequency Configuration
T0 APLL
FREQUENCY (MHz)
T0 APLL DFS
FREQUENCY (MHz)
T0 APLL
FREQUENCY MODE
T0FREQ[2:0] SETTING
OUTPUT JITTER
(pk-pk, ns, typ)
311.04
77.76
77.76MHz
000
< 0.5
311.04
77.76
77.76MHz
001
< 0.5
98.304
24.576
12 x E1
010
< 0.5
131.072
32.768
16 x E1
011
< 0.5
148.224
37.056
24 x DS1
100
< 0.5
98.816
24.704
16 x DS1
101
< 0.5
100.992
25.248
4 x 6312kHz
110
< 0.5
250.000
62.500
GbE
÷ 16
111
< 0.5
Table 7-11. T0 APLL2 Frequency Configuration
T0 APLL2
FREQUENCY (MHz)
T0 APLL2 DFS
FREQUENCY(MHz)
OUTPUT JITTER
(pk-pk, ns, typ)
312.500
62.500
< 0.5
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PDF描述
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