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參數(shù)資料
| 型號： | COLDFIRE3UM |
| 英文描述： | Version 3 ColdFire Core User＇s Manual |
| 中文描述： | 版本3 ColdFire內(nèi)核的用戶手冊 |
| 文件頁數(shù)： | 9/253頁 |
| 文件大?。?/td> | 1762K |
| 代理商： | COLDFIRE3UM |
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TABLE OF CONTENTS (Continued)
Paragraph
Number
Page
Number
Title
MOTOROLA
ColdFire2/2M User’s Manual
For More Information On This Product,
Go to: www.freescale.com
xi
3.1.10
3.1.11
3.1.12
3.1.13
3.1.14
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3.1.17
3.2
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3.2.2
3.3
3.3.1
3.3.2
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3.3.4
3.4
3.5
3.6
3.7
3.7.1
3.7.2
3.8
3.8.1
3.8.2
3.9
3.10
3.10.1
3.10.1.1
3.10.1.2
3.10.1.3
3.10.2
Master Size (MSIZ[1:0])..........................................................................3-2
Master Transfer Acknowledge (MTAB) ..................................................3-2
Master Transfer Error Acknowledge (MTEAB).......................................3-3
Master Transfer Modifier (MTM[2:0])......................................................3-3
Master Transfer Start (MTSB) ................................................................3-3
Master Transfer Type (MTT[1:0]) ...........................................................3-3
Master Write Data Bus (MWDATA[31:0])...............................................3-4
Master Write Data Output Enable (MWDATAOE)..................................3-4
Data Transfer Mechanism ...........................................................................3-4
Transfer Type Control Signals................................................................3-4
ColdFire2/2M Access.........................................................................3-4
Alternate Master Access....................................................................3-5
Emulator Mode Access......................................................................3-5
Interrupt Acknowledge Access ..........................................................3-5
CPU Space Access ...........................................................................3-5
Data Bus Requirements .........................................................................3-5
Data Transfers.............................................................................................3-6
Byte, Word, and Longword Read Transfers...........................................3-6
Byte, Word, and Longword Write Transfers ...........................................3-9
Line Read Transfer...............................................................................3-11
Line Write Transfers .............................................................................3-14
Misaligned Operands.................................................................................3-18
Invalid Master Bus Cycles .........................................................................3-20
Pipeline Stalls............................................................................................3-20
Interrupt Acknowledge Bus Cycles............................................................3-21
Interrupt Acknowledge Bus Cycle (Terminated normally) ....................3-22
Spurious Interrupt Acknowledge Bus Cycle .........................................3-27
Master Bus Exception Control Cycles .......................................................3-27
Bus Errors.............................................................................................3-28
Fault-on-Fault Halt................................................................................3-29
Reset Operation.........................................................................................3-29
Master Bus Arbitration...............................................................................3-30
Master Bus Arbitration Algorithm..........................................................3-30
Park on ColdFire2/2M......................................................................3-30
Park on Alternate Master.................................................................3-30
Park on Current Master ...................................................................3-31
Bus Arbitration Programming Model.....................................................3-31
Section 4
Exception Processing
4.1
Exception Processing Overview..................................................................4-1
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| COM150A | 100V Single N-Channel Hi-Rel MOSFET in a TO-254AA package |
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| COM2502P | UART |
| COM250A | 200V Single N-Channel Hi-Rel MOSFET in a TO-254AA package |
| COM350A | 400V Single N-Channel Hi-Rel MOSFET in a TO-254AA package |
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參數(shù)描述 |
|---|---|
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| COLDS/002 | 制造商:Farnell / Duratool 功能描述:JOBBER DRILL SET 1.0-13.0X0.5MM |
| COLINKEX | 制造商:Embest Info&Tech Co Ltd 功能描述:ADAPTER DEBUG SW/JTAG 制造商:EMBEST 功能描述:ADAPTER, DEBUG, SW/JTAG 制造商:EMBEST 功能描述:DEBUGGER, LPC13XX; Silicon Family Name:LPC13xx; Core Architecture:ARM; Core Sub-Architecture:Cortex-M3; IC Product Type:Debugger; Features:Support Cortex M0 and Cortex M3 Devices, Support Software & JTAG Debugging ;RoHS Compliant: Yes |
| COLINKEX"LPC11C14 EVB | 制造商:Embest Info&Tech Co Ltd 功能描述:DEVELOPMENT TOOL CORTEX-M0 LPC11C14 制造商:Embest Info&Tech Co Ltd 功能描述:DEVELOPMENT TOOL, CORTEX-M0, LPC11C14 |
| COLINKEX_LPC11C14 EVB | 制造商:Embest Info&Tech Co Ltd 功能描述:BOARD EVAL LPC1114 W/ COLINK 制造商:Embest Info&Tech Co Ltd 功能描述:BOARD EVAL LPC1114 W/ COLINKEX 制造商:EMBEST 功能描述:BOARD, EVAL, LPC1114 W/ COLINKEX 制造商:EMBEST 功能描述:DEVELOPMENT TOOL, CORTEX-M0, LPC11C14; Silicon Manufacturer:NXP; Core Architecture:ARM; Core Sub-Architecture:Cortex-M0; Silicon Core Number:LPC11C14; Silicon Family Name:LPC11Cxx ;RoHS Compliant: Yes |
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