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參數(shù)資料
| 型號： | UPD780076 |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-Bit Single-Chip Microcontrollers |
| 中文描述： | 8位單芯片微控制器 |
| 文件頁數(shù)： | 263/592頁 |
| 文件大?。?/td> | 3307K |
| 代理商： | UPD780076 |
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263
CHAPTER 14 SERIAL INTERFACE UART0
User
’
s Manual U14260EJ3V1UD
(e) Receive errors
Three types of errors can occur during a receive operation: a parity error, framing error, or overrun error.
If, as the result of data reception, an error flag is set in asynchronous serial interface status register 0 (ASIS0),
a receive error interrupt request (INTSER0) will occur. Receive error interrupts are generated before the
receive completion interrupt request (INTSR0). Table 14-4 lists the causes behind receive errors.
As part of receive error interrupt request (INTSER0) servicing, the contents of ASIS0 can be read to determine
which type of error occurred during the receive operation (see
Table 14-4
and
Figure 14-12
).
The contents of ASIS0 are reset (to 0) when receive buffer register 0 (RXB0) is read or when the next data
is received (if the next data contains an error, its error flag will be set).
Table 14-4. Causes of Receive Errors
Receive Error
Cause
Parity error
Parity specified does not match parity of receive data
Framing error
Stop bit was not detected
Overrun error
Reception of the next data was completed before data was read from receive buffer
register 0 (RXB0)
Figure 14-12. Receive Error Timing
RxD0 (input)
D0
D1
D2
D6
D7
Parity
Stop
Start
INTSR0
Note
INTSER0
(When framing/overrun error occurs)
INTSER0
(When parity error occurs)
Note
Even if a receive error occurs when the ISRM0 bit has been set (1), INTSR0 does not occur.
Cautions 1. The contents of asynchronous serial interface status register 0 (ASIS0) are reset (to
0) when receive buffer register 0 (RXB0) is read or when the next data is received. To
obtain information about the error, be sure to read the contents of ASIS0 before reading
RXB0.
2. Be sure to read the contents of receive buffer register 0 (RXB0) after the receive
completion interrupt request has occurred even when a receive error has occurred. If
RXB0 is not read after the receive completion interrupt request has occurred, overrun
errors will occur during the next data receive operations and the receive error status
will remain until the contents of RXB0 are read.
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