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參數(shù)資料
| 型號(hào)： | STLC7545 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Enhanced V.34 BIS Analog Front-End(單片模擬前端) |
| 中文描述： | 國(guó)際清算銀行增強(qiáng).34模擬前端（單片模擬前端） |
| 文件頁(yè)數(shù)： | 36/53頁(yè) |
| 文件大小： | 378K |
| 代理商： | STLC7545 |
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VI - PROGRAMMABLE FUNCTIONS
(continued)
VI.2.3- ReceiveBitRateClockFrequencyProgrammingwithMasterClockFrequencyFQ=18.432MHz
Table30 :
ReceiveBitRate ClockFrequencyProgrammingWithMasterClockFrequencyFQ=18.432MHz
RxCRO Register
D3
S0
1
1
0
0
1
0
1
0
1
0
0
0
0
0
0
Bit Rate Clock Frequency (Hz)
(FQ = 18.432MHz)
Rxclk = FQ/(N*R*S*T*CS) (1)
D7
N0
0
1
0
0
0
1
1
0
0
1
0
0
0
0
0
D6
R1
1
1
1
0
1
1
1
1
1
1
1
1
1
1
1
D5
R0
1
1
1
0
1
1
1
1
1
1
1
1
1
1
1
D4
S1
0
0
1
1
0
1
0
1
0
1
1
1
1
1
1
D2
T2
0
0
0
0
0
0
0
0
0
0
0
0
1
1
1
D1
T1
0
0
0
0
0
0
0
0
1
0
1
1
0
0
1
D0
T0
0
0
0
0
1
0
1
1
0
1
0
1
0
1
0
Divisor rank
576
768
960
32000
24000
19200
16800
16000
14400
12000
9600 (INI)
8000
7200
4800
2400
1200
600
300
960*8/7
1152
1280
1536
1920
2304
2560
3840
7680
15360
30720
61440
INI : initial value
Notes :
1. The QS bit (D13) in TxCTRL wordmust be set 1 to have CS = 8.
The bit R2 in the TxCR2 register (bit D0) must be set to 0.
STLC7545
36/53
相關(guān)PDF資料 |
PDF描述 |
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| STLVD210 | DIFFERENTIAL LVDS CLOCK DRIVER |
| STLVD210BF | DIFFERENTIAL LVDS CLOCK DRIVER |
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參數(shù)描述 |
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| STLC7546TQFP4Y | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MODEM CIRCUIT|ANALOG FRONT END|CMOS|QFP|44PIN|PLASTIC |
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