參數(shù)資料
型號： STLC7545
廠商： 意法半導(dǎo)體
英文描述： Enhanced V.34 BIS Analog Front-End(單片模擬前端)
中文描述： 國際清算銀行增強.34模擬前端（單片模擬前端）
文件頁數(shù)： 28/53頁
文件大小： 378K
代理商： STLC7545
VI - PROGRAMMABLE FUNCTIONS
(continued)
VI.1.3-TransmitBit RateClockFrequencyProgrammingwithMasterClockFrequencyFQ=18.432MHz
Table13 :
TransmitBitRateClockFrequencyProgrammingwith MasterClockFrequencyFQ=18.432MHz
TxCRO Register
D7
D6
D5
D4
D3
D2
D1
N0
R1
R0
S1
S0
T2
T1
0
1
1
0
1
0
0
1
1
1
0
1
0
0
0
1
1
1
0
0
0
0
0
0
1
0
0
0
0
1
1
0
1
0
0
1
1
1
1
0
0
0
1
1
1
0
1
0
0
0
1
1
1
0
0
0
0
1
1
0
1
0
1
1
1
1
1
0
0
0
0
1
1
1
0
0
1
0
1
1
1
0
0
1
0
1
1
1
0
1
0
0
1
1
1
0
1
0
0
1
1
1
0
1
1
Bit Rate Clock Frequency (Hz)
Txclk=
FQ/(N*R*S*T*CS) (1)
D0
T0
0
0
0
0
1
0
1
1
0
1
0
1
0
1
0
Divisor
rank
576
768
960
32000
24000
19200
16800
16000
14400
12000
9600 (INI)
8000
7200
4800
2400
1200
600
300
960x8/7
1152
1280
1536
1920
2304
2560
3840
7680
15360
30720
61440
INI : initial value
Notes :
1. The bit R2 and R3 in the TxCR2 register (bit D0 and D2) must be set to 0.
The QS bit in TxCTRL word mustbe set to 1 to have CS = 16.
STLC7545
28/53
相關(guān)PDF資料
PDF描述
STLC7549 Stereo Audio/MODEM/Telephony Codec(立體聲音頻/調(diào)制解調(diào)器/電話編解碼器)
STLVD210B DIFFERENTIAL LVDS CLOCK DRIVER
STLVD210 DIFFERENTIAL LVDS CLOCK DRIVER
STLVD210BF DIFFERENTIAL LVDS CLOCK DRIVER
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參數(shù)描述
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