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參數(shù)資料
| 型號(hào)： | S1D13706 |
| 廠商： | 愛普生（中國）有限公司 |
| 英文描述： | S1D13706 Embedded Memory LCD Controller |
| 中文描述： | S1D13706 LCD控制器的嵌入式存儲(chǔ)器 |
| 文件頁數(shù)： | 92/152頁 |
| 文件大?。?/td> | 1784K |
| 代理商： | S1D13706 |
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Page 92
Epson Research and Development
Vancouver Design Center
S1D13706
X31B-A-001-09
Hardware Functional Specification
Issue Date: 2004/02/09
There is a relationship between the frequency of MCLK and PCLK that must be
maintained.
7.1.4 PWMCLK
PWMCLK is the internal clock used by the Pulse Width Modulator for output to the panel.
The source clock options for PWMCLK may be selected as in the following table.
For further information on controlling PWMCLK, see Section 8.3.9, “Pulse Width
Modulation (PWM) Clock and Contrast Voltage (CV) Pulse Configuration Registers” on
page 126.
Note
The S1D13706 provides Pulse Width Modulation output on the pin PWMOUT.
PWMOUT can be used to control LCD panels which support PWM control of the back-
light inverter.
Table 7-4: Relationship between MCLK and PCLK
SwivelView Orientation
Color Depth (bpp)
16
8
4
2
1
16/8/4/2/1
MCLK to PCLK Relationship
f
MCLK
≥
f
PCLK
f
MCLK
≥
f
PCLK
÷
2
f
MCLK
≥
f
PCLK
÷
4
f
MCLK
≥
f
PCLK
÷
8
f
MCLK
≥
f
PCLK
÷
16
f
MCLK
≥ 1.25
f
PCLK
SwivelView 0° and 180°
SwivelView 90° and 270°
Table 7-5: PWMCLK Clock Selection
Source Clock Options
CLKI
CLKI2
PWMCLK Selection
REG[B1h] bit 0 = 0
REG[B1h] bit 0 = 1
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