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參數(shù)資料
| 型號(hào)： | S1D13706 |
| 廠商： | 愛普生（中國）有限公司 |
| 英文描述： | S1D13706 Embedded Memory LCD Controller |
| 中文描述： | S1D13706 LCD控制器的嵌入式存儲(chǔ)器 |
| 文件頁數(shù)： | 128/152頁 |
| 文件大小： | 1784K |
| 代理商： | S1D13706 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁當(dāng)前第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁
Page 128
Epson Research and Development
Vancouver Design Center
S1D13706
X31B-A-001-09
Hardware Functional Specification
Issue Date: 2004/02/09
bits 7-4
PWM Clock Divide Select Bits [3:0]
The value of these bits represents the power of 2 by which the selected PWM clock source
is divided.
Note
This divided clock is further divided by 256 before it is output at PWMOUT.
bits 3-1
CV Pulse Divide Select Bits [2:0]
The value of these bits represents the power of 2 by which the selected CV Pulse source is
divided.
Note
This divided clock is further divided by 2 before it is output at the CVOUT.
bit 0
PWMCLK Source Select
When this bit = 0, the clock source for PWMCLK is CLKI.
When this bit = 1, the clock source for PWMCLK is CLKI2.
Note
For further information on the PWMCLK source select, see Section 7.2, “Clock Selec-
tion” on page 93.
PWM Clock / CV Pulse Configuration Register
REG[B1h]
Read/Write
PWM Clock Divide Select Bits 3-0
CV Pulse Divide Select Bits 2-0
PWMCLK
Source Select
7
6
5
4
3
2
1
0
Table 8-17: PWM Clock Divide Select Options
PWM Clock Divide Select Bits [3:0]
0h
1h
2h
3h
...
Ch
Dh-Fh
PWM Clock Divide Amount
1
2
4
8
...
4096
Reserved
Table 8-18: CV Pulse Divide Select Options
CV Pulse Divide Select Bits [2:0]
0h
1h
2h
3h
...
7h
CV Pulse Divide Amount
1
2
4
8
...
128
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