參數資料
型號： ORT82G5
英文描述： ORCA ORT82G5 1.0.1-25/2.0-2.5/3.125 Gbits/s Backplane Interface FPSC
中文描述： ORCA的ORT82G5 1.0.1-25/2.0-2.5/3.125 Gb /秒背板接口促進文化基金
文件頁數： 53/92頁
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代理商： ORT82G5
Agere Systems Inc.
53
Preliminary Data Sheet
July 2001
1.0-1.25/2.0-2.5/3.125 Gbits/s Backplane Interface
ORCA
ORT82G5 FPSC Eight-Channel
Memory Map
(continued)
Table 12. Memory Map
(continued)
Addr
(Hex)
Common Control Registers
30A00
C0
Reg
#
DB0
DB1
DB2
DB3
DB4
DB5
DB6
DB7
Default
Value
TCKSELA
Controls source of 78 MHz
TCK78 for bank A
Reserved for future use
RCKSELA
Controls source of 78 MHz
RCK78 for bank A
TCKSELB
Controls source of 78 MHz
TCK78 for bank B
RCKSELB
controls source of 78 MHz
RCK78 for bank B
00
30A01
C1
RX_FIFO_MI
N
Threshold for
low address in
RX_FIFO’s
00
30A02
C2
RX_FIFO_MIN
Threshold for low address in
RX_FIFO’s
FMPU_RESY
NC8
Resync 8
channels,
A[A:D], B[A:D]
Reserved for future use
00
Common Status Registers
30A04
C4
SYNC8_OVFL
Alignment
FIFO overflow
for A[A:D],
B[A:D]
SYNC8_OOS
Alignment out
of sync for
A[A:D], B[A:D]
Reserved for future use
00
30A05
C5
Reserved for future use
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PDF描述
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