參數(shù)資料
型號： DAC1617D1G0HN
廠商： NXP Semiconductors N.V.
元件分類： 外設(shè)及接口
英文描述： Dual 16-bit DAC: up to 1 Gsps; x2, x4 and x8 interpolating
封裝： DAC1617D1G0HN/C1<SOT813-3 (HVQFN72)|<<http://www.nxp.com/packages/SOT813-3.html<1<Always Pb-free,;DAC1617D1G0HN/C1<SOT813-3 (HVQFN72)|<<http://www.nxp.com/packages/SOT813
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代理商： DAC1617D1G0HN
NXP Semiconductors
DAC1617D1G0
Dual 16-bit DAC: up to 1 Gsps; x2, x4 and x8 interpolating
NXP B.V. 2011.
All rights reserved.
For more information, please visit: http://www.nxp.com
For sales office addresses, please send an email to: salesaddresses@nxp.com
Date of release: 30 September 2011
Document identifier: DAC1617D1G0
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18. Contents
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10.7.1
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10.12
10.12.1
10.12.2
10.13
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10.15
10.16
10.16.1
General description. . . . . . . . . . . . . . . . . . . . . . 1
Features and benefits . . . . . . . . . . . . . . . . . . . . 1
Applications . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2
Ordering information. . . . . . . . . . . . . . . . . . . . . 2
Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . 3
Pinning information. . . . . . . . . . . . . . . . . . . . . . 4
Pinning . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4
Pin description . . . . . . . . . . . . . . . . . . . . . . . . . 4
Limiting values. . . . . . . . . . . . . . . . . . . . . . . . . . 7
Thermal characteristics . . . . . . . . . . . . . . . . . . 7
Characteristics. . . . . . . . . . . . . . . . . . . . . . . . . . 8
Application information. . . . . . . . . . . . . . . . . . 13
General description . . . . . . . . . . . . . . . . . . . . 13
Serial Peripheral Interface (SPI). . . . . . . . . . . 13
Protocol description . . . . . . . . . . . . . . . . . . . . 13
SPI timing description. . . . . . . . . . . . . . . . . . . 15
Power-on sequence . . . . . . . . . . . . . . . . . . . . 15
LVDS Data Input Format (DIF) block . . . . . . . 16
Input port polarity . . . . . . . . . . . . . . . . . . . . . . 16
Input port mapping . . . . . . . . . . . . . . . . . . . . . 16
Input port swapping . . . . . . . . . . . . . . . . . . . . 17
Input port formatting . . . . . . . . . . . . . . . . . . . . 18
Input clock . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
LVDS DDR clock. . . . . . . . . . . . . . . . . . . . . . . 19
DAC core clock. . . . . . . . . . . . . . . . . . . . . . . . 19
Timing. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
Operating modes . . . . . . . . . . . . . . . . . . . . . . 22
CDI mode 0 (x2 interpolation). . . . . . . . . . . . . 22
CDI mode 1 (x4 interpolation). . . . . . . . . . . . . 23
CDI mode 2 (x8 interpolation). . . . . . . . . . . . . 24
FIR filters . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
Single SideBand Modulator (SSBM). . . . . . . . 26
NCO in 40 bits . . . . . . . . . . . . . . . . . . . . . . . . 26
NCO low power . . . . . . . . . . . . . . . . . . . . . . . 27
Complex modulator . . . . . . . . . . . . . . . . . . . . 27
Minus 3dB. . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Inverse sinx / x . . . . . . . . . . . . . . . . . . . . . . . . 28
DAC transfer function . . . . . . . . . . . . . . . . . . . 28
Full-scale current . . . . . . . . . . . . . . . . . . . . . . 29
Regulation . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
Full-scale current adjustment . . . . . . . . . . . . . 30
Digital offset adjustment . . . . . . . . . . . . . . . . . 30
Analog output . . . . . . . . . . . . . . . . . . . . . . . . . 30
Auxiliary DACs . . . . . . . . . . . . . . . . . . . . . . . . 31
Output configuration . . . . . . . . . . . . . . . . . . . . 32
Basic output configuration . . . . . . . . . . . . . . . 32
10.16.2
10.16.3
10.16.4
10.17
10.17.1
10.18
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IQ-modulator - BGX7100 interface . . . . . . . . 33
IQ-modulator - DC interface. . . . . . . . . . . . . . 33
IQ-modulator - AC interface. . . . . . . . . . . . . . 36
Design recommendations . . . . . . . . . . . . . . . 36
Power and grounding. . . . . . . . . . . . . . . . . . . 36
Configuration interface. . . . . . . . . . . . . . . . . . 37
Register description. . . . . . . . . . . . . . . . . . . . 37
Page 0 register allocation map . . . . . . . . . . . 38
Page 0 bit definition detailed description . . . . 40
Page 1 allocation map . . . . . . . . . . . . . . . . . . 45
Page 1 bit definition detailed description . . . . 47
Page A register allocation map . . . . . . . . . . . 52
Page A bit definition detailed description. . . . 54
Package outline. . . . . . . . . . . . . . . . . . . . . . . . 59
Abbreviations . . . . . . . . . . . . . . . . . . . . . . . . . 60
Glossary. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
Static parameters. . . . . . . . . . . . . . . . . . . . . . 61
Dynamic parameters . . . . . . . . . . . . . . . . . . . 61
Revision history . . . . . . . . . . . . . . . . . . . . . . . 62
Legal information . . . . . . . . . . . . . . . . . . . . . . 63
Data sheet status. . . . . . . . . . . . . . . . . . . . . . 63
Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . 63
Disclaimers . . . . . . . . . . . . . . . . . . . . . . . . . . 63
Trademarks . . . . . . . . . . . . . . . . . . . . . . . . . . 64
Contact information . . . . . . . . . . . . . . . . . . . . 64
Tables. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65
Contents. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 66
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