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參數(shù)資料
| 型號(hào)： | CD1865 |
| 廠商： | Intel Corp. |
| 英文描述： | Intelligent Eight-Channel Communications Controller |
| 中文描述： | 智能八通道通信控制器 |
| 文件頁數(shù)： | 85/150頁 |
| 文件大?。?/td> | 871K |
| 代理商： | CD1865 |
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Intelligent Eight-Channel Communications Controller
—
CD1865
Datasheet
85
by hardware or software, the CD1865 does not initialize every register and RAM location to a
defined value. The only sure state is that all channels are inactive, no service requests are pending,
and the Global Interrupt Vector register is FF Hex.
Figure 28. Initialization
INITIALIZATION
N
Y
MASTER
CHIP
RESET
GLOBAL
INITIALIZATION
CHANNEL
INITIALIZATION
Y
LOAD SCHR1-3, MSVR,
MCOR1-2, TRANSMIT/RECEIVE
LOAD GSVR WITH CHIP ID,
PILRS WITH VECTORS, AND
PRESCALE REGISTERS
LOAD COR1-3 WITH
CHARACTER SETTINGS
AND OPERATION MODES
ISSUE COR CHANGE
COMMAND IN CCR
LOAD CAR WITH A
‘
0
’
N
Y
DONE
GSVR
= FF
CCR
= 0
LAST
CHANNEL
(CAR=8)
INCREMENT CAR
N
After either a hardware reset by the RESET pin or a software reset
by a CCR command, wait until the GSVR= xFF before proceeding
with chip initialization.
When the CD1865 is ready, begin by loading the GSVR with the
chip ID if there are more than one CD1865 in the system. Load
the Service Match registers with the vectors that will be used during
service acknowledge cycles. Load the Prescale registers with the
value chosen for the basic time count for timer operations.
In preparation for channel initialization, load the CAR with a
‘
0
’
to
access Channel Zero registers.
for the CCR to contain a value of zero to ensure that the
CD1865 is not processing a previous change command for that
channel.
Load the Channel Option registers with the values to enable the
desired modes of operation and character parameters such as
parity, stop bits, and so on.
Inform the CD1865 that one or more Channel Option registers
have changed via the COR Change Command.
Option registers for modem interrupt conditions; the MSVR with the
states of DTR/RTS as necessary and the baud rate constants for
Transmit and Receive Baud Rate Generators. Set the appropriate
bits in the SRER register for the interrupt conditions desired.
If more channels, go back to the top of the loop.
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