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參數(shù)資料
| 型號： | μPD98501 |
| 廠商： | NEC Corp. |
| 英文描述： | Network Controller(網(wǎng)絡(luò)控制器) |
| 中文描述： | 網(wǎng)絡(luò)控制器（網(wǎng)絡(luò)控制器） |
| 文件頁數(shù)： | 106/671頁 |
| 文件大?。?/td> | 2229K |
| 代理商： | ΜPD98501 |
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CHAPTER 2 V
R
4120A
106
Preliminary User’s Manual S14767EJ1V0UM00
Table 2-38. Shift Instructions (2/2)
Instruction
Format and Description
Doubleword Shift Left
Logical
DSLL rx, ry, immediate
The 64-bit doubleword contents of general register ry are shifted left, and zeros are inserted into the
emptied low-order bits. The 3-bit immediate specifies the shift count. A shift count of 0 is interpreted
as a shift count of 8. The 64-bit result is placed in general register rx.
This operation is defined in the 64-bit mode and the 32-bit kernel mode. When this instruction is
executed in the 32-bit user/supervisor mode, a reserved instruction exception is generated.
Doubleword Shift Right
Logical
DSRL ry, immediate
The 64-bit doubleword contents of general register ry are shifted right, and zeros are inserted into the
emptied high-order bits. The 3-bit immediate specifies the shift count. A shift count of 0 is interpreted
as a shift count of 8. The result is placed in general register ry.
This operation is defined in the 64-bit mode and the 32-bit kernel mode. When this instruction is
executed in the 32-bit user/supervisor mode, a reserved instruction exception is generated.
Doubleword Shift Right
Arithmetic
DSRA ry, immediate
The 64-bit doubleword contents of general register ry are shifted right, and the emptied high-order bits
are sign extended. The 3-bit immediate specifies the shift count. A shift count of 0 is interpreted as a
shift count of 8. The result is placed in general register ry.
This operation is defined in the 64-bit mode and the 32-bit kernel mode. When this instruction is
executed in the 32-bit user/supervisor mode, a reserved instruction exception is generated.
Doubleword Shift Left
Logical Variable
DSLLV ry, rx
The 64-bit doubleword contents of general register ry are shifted left, and zeros are inserted into the
emptied low-order bits. The six low-order bits of general register rx specify the shift count. The result
is placed in general register ry.
This operation is defined in the 64-bit mode and the 32-bit kernel mode. When this instruction is
executed in the 32-bit user/supervisor mode, a reserved instruction exception is generated.
Doubleword Shift Right
Logical Variable
DSRLV ry, rx
The 64-bit doubleword contents of general register ry are shifted right, and zeros are inserted into the
emptied high-order bits. The six low-order bits of general register rx specify the shift count. The result
is placed in general register ry.
This operation is defined in the 64-bit mode and the 32-bit kernel mode. When this instruction is
executed in the 32-bit user/supervisor mode, a reserved instruction exception is generated.
Doubleword Shift Right
Arithmetic Variable
DSRAV ry, rx
The 64-bit doubleword contents of general register ry are shifted right, and the emptied high-order bits
are sign extended. The six low-order bits of general register rx specify the shift count. The result is
placed in general register ry.
This operation is defined in the 64-bit mode and the 32-bit kernel mode. When this instruction is
executed in the 32-bit user/supervisor mode, a reserved instruction exception is generated.
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