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參數(shù)資料
| 型號(hào)： | ST72331 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 8-Bit MCU with 8 to 16K ROM/OTP/EPROM, 256 EEPROM, 384 to 512 Bytes RAM, ADC, WDG, SCI, SPI and 2 Timers(8位微控制器(8M)) |
| 中文描述： | 8位微控制器與8至16K的光碟/雙層/存儲(chǔ)器，256的EEPROM，384字節(jié)RAM為512，藝發(fā)局，水分散粒劑，脊髓損傷，SPI和2計(jì)時(shí)器（8位微控制器（8米）） |
| 文件頁(yè)數(shù)： | 87/98頁(yè) |
| 文件大?。?/td> | 1123K |
| 代理商： | ST72331 |
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87/98
ST72331
PERIPHERAL CHARACTERISTICS
(Cont’d)
Serial Peripheral Interface
Ref.
Characteristics
Configuration
Symbol
Value
Unit
Min.
Max.
SPI Frequency
Master
f
SPI
(m)
f
CPU
Slave
f
SPI
(s)
dc
f
CPU
1
Cycle Time
Master
t
CYC(m)
4
500
2
250
CC
ns
CC
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Slave
t
CYC(s)
2
Enable Lead Time
Master
Slave
Master
Slave
Master
Slave
Master
Slave
Master
Slave
Master
Slave
t
LEAD(m)
t
LEAD(s)
120
3
Enable Lag time
120
100
90
100
90
100
100
100
100
4
Clock (SCK)High Time
t
W(SCKH)
t
W(SCKH)
t
W(SCKL)
t
W(SCKL)
t
SU(m)
t
SU(s)
t
H(m)
t
H(s)
5
Clock (SCK) Low Time
6
Data Set-up Time
7
Data Hold Time (Inputs)
8
Access Time (Time to Data Active
from High Impedance State)
Disable Time (Hold Time to High
Impedance State)
Slave
t
A
0
120
ns
9
Slave
t
DIS
240
ns
10
Data Valid
Master (Before Capture
Edge)
Slave (After Enable Edge)
Master (Before Capture
Edge)
Slave (After Enable Edge)
SPI Outputs (SCK, MOSI,
MISO)
SPI Inputs (SCK, MOSI, MI-
SO, SS)
SPI Outputs (SCK, MOSI,
MISO)
SPI Inputs (SCK, MOSI, MI-
SO, SS)
t
V(m)
0.25
t
CYC(m)
t
V(s)
120
ns
11
Data Hold Time (Outputs)
t
HO(m)
0.25
t
CYC(m)
t
HO(s)
0
ns
12
Rise Time (20% V
DD
to 70% V
DD
,
C
L
= 200pF)
t
RM
100
ns
t
RS
2.0
μ
s
13
Fall Time (70% V
DD
to 20% V
DD
, C
L
= 200pF)
t
FM
100
ns
t
FS
2.0
μ
s
128
--1
1
4
1
2
149
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