參數(shù)資料
型號: SPAK56F8346FV60
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 數(shù)字信號處理
英文描述: 16-BIT, 240 MHz, OTHER DSP, PQFP144
封裝: 20 X 20 MM, 0.50 MM PITCH, 1.40 MM HEIGHT, PLASTIC, LQFP-144
文件頁數(shù): 69/156頁
文件大?。?/td> 2219K
代理商: SPAK56F8346FV60
2
56F8346 Technical Data
MOTOROLA
Preliminary
Part 1: Overview . . . . . . . . . . . . . . . . . . . . 3
1.1. 56F8346 Features. . . . . . . . . . . . . . . . . . . 3
1.2. 56F8346 Description . . . . . . . . . . . . . . . . 4
1.3. Award-Winning Development
Environment . . . . . . . . . . . . . . . 5
1.4. Architecture Block Diagram . . . . . . . . . . 5
1.5. Product Documentation . . . . . . . . . . . . . 8
1.6. Data Sheet Conventions. . . . . . . . . . . . . . 9
Part 2: Signal/Connection Descriptions . 10
2.1. Introduction . . . . . . . . . . . . . . . . . . . . . . 10
2.2. 56F8346 Signal Pins . . . . . . . . . . . . . . . 12
Part 3: On-Chip Clock Synthesis (OCCS) 30
3.1. Introduction . . . . . . . . . . . . . . . . . . . . . . 30
3.2. External Clock Operation . . . . . . . . . . . 30
3.3. Registers. . . . . . . . . . . . . . . . . . . . . . . . . 32
Part 4: Memory Map . . . . . . . . . . . . . . . . 33
4.1. Introduction . . . . . . . . . . . . . . . . . . . . . . 33
4.2. Program Map . . . . . . . . . . . . . . . . . . . . . 33
4.3. Interrupt Vector Table . . . . . . . . . . . . . . 35
4.4. Data Map . . . . . . . . . . . . . . . . . . . . . . . . 38
4.5. Flash Memory Map . . . . . . . . . . . . . . . . 38
4.6. EOnCE Memory Map . . . . . . . . . . . . . . 40
4.7. Peripheral Memory Mapped Registers . 41
Part 5: Interrupt Controller (ITCN) . . . 66
5.1. Introduction . . . . . . . . . . . . . . . . . . . . . . 66
5.2. Features . . . . . . . . . . . . . . . . . . . . . . . . . 66
5.3. Functional Description. . . . . . . . . . . . . . 66
5.4. Block Diagram . . . . . . . . . . . . . . . . . . . 68
5.5. Operating Modes . . . . . . . . . . . . . . . . . . 68
5.6. Register Descriptions . . . . . . . . . . . . . . 68
5.7. Resets . . . . . . . . . . . . . . . . . . . . . . . . . . . 93
Part 6: System Integration
Module (SIM) . . . . . . . . . . . . . . . . . . . . . . 94
6.1. Overview . . . . . . . . . . . . . . . . . . . . . . . . 94
6.2. Features . . . . . . . . . . . . . . . . . . . . . . . . . 94
6.3. Operating Modes . . . . . . . . . . . . . . . . . . 95
6.4. Operation Mode Register. . . . . . . . . . . . 95
6.5. Register Descriptions . . . . . . . . . . . . . . . 96
6.6. Clock Generation Overview . . . . . . . . 108
6.7. Power-Down Modes Overview . . . . . 108
6.8. Stop and Wait Mode Disable Function 109
6.9. Resets . . . . . . . . . . . . . . . . . . . . . . . . . . 109
Part 7: Security Features . . . . . . . . . . . 110
7.1. Operation with Security Enabled
110
7.2. Flash Access Blocking Mechanisms . . 110
Part 8: General Purpose Input/Output
(GPIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . 113
8.1. Introduction . . . . . . . . . . . . . . . . . . . . . 113
8.2. Configuration . . . . . . . . . . . . . . . . . . . . 113
8.3. Memory Maps. . . . . . . . . . . . . . . . . . . 117
Part 9: Joint Test Action
Group (JTAG) . . . . . . . . . . . . . . . . . . . . . 117
9.1. 56F8346 Information . . . . . . . . . . . . . . 117
Part 10: Specifications . . . . . . . . . . . . . . 118
10.1. General Characteristics. . . . . . . . . . . 118
10.2. DC Electrical Characteristics . . . . . . . 123
10.3. AC Electrical Characteristics . . . . . . . 126
10.4. Flash Memory Characteristics . . . . . 127
10.5. External Clock Operation Timing . . . 128
10.6. Phase Locked Loop Timing . . . . . . . . 128
10.7. Crystal Oscillator Timing . . . . . . . . . 129
10.8. External Memory Interface Timing . . 129
10.9. Reset, Stop, Wait, Mode Select,
and Interrupt Timing . . . . . . . 132
10.10. Serial Peripheral Interface
(SPI) Timing . . . . . . . . . . . . . 134
10.11. Quad Timer Timing . . . . . . . . . . . . . 137
10.12. Quadrature Decoder Timing . . . . . . 137
10.13. Serial Communication Interface (SCI)
Timing . . . . . . . . . . . . . . . . . . 138
10.14. Controller Area Network
(CAN) Timing . . . . . . . . . . . . 139
10.15. JTAG Timing . . . . . . . . . . . . . . . . . 139
10.16. Analog-to-Digital Converter (ADC)
Parameters . . . . . . . . . . . . . . 141
10.17. Equivalent Circuit for ADC Inputs. 142
10.18. Power Consumption . . . . . . . . . . . . 142
Part 11: Packaging. . . . . . . . . . . . . . . . . 144
11.1. Package and Pin-Out
Information 56F8346 . . . . . . 144
Part 12: Design Considerations . . . . . . . 148
12.1. Thermal Design Considerations . . . . 148
12.2. Electrical Design Considerations . . . 149
12.3. Power Distribution and I/O Ring
Implementation . . . . . . . . . . . 150
Part 13: Ordering Information . . . . . . . 151
56F8346 Data Sheet Table of Contents
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