參數(shù)資料
型號： SYM53C875
廠商： LSI Corporation
英文描述： PCI-Ultra SCSI I/O Processor(PCI-Ultra SCSI I/O處理器)
中文描述： 的PCI -超的SCSI I / O處理器（個PCI -超的SCSI的I / O處理器）
文件頁數(shù)： 49/243頁
文件大小： 1362K
代理商： SYM53C875
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Functional Description
Power Management
SYM53C875/875E Data Manual
2-27
Power Management
T he SYM53C875E complies with the PCI Bus
Power Management Interface Specification, Revi-
sion 1.0. T he PCI Function Power States are
defined in that specification: D0, D1, D2, and D3.
D0 and D3 are required by specification, and D1
and D2 are optional. D0 is the maximum powered
state, and D3 is the minimum powered state.
Power state D3 is further categorized as D3hot or
D3cold. A function that is powered off is said to be
in the D3cold power state.
T he power states for the SCSI function are inde-
pendently controlled through two power state bits
that are located in the PCI Configuration Space
Register 44h. T he bits are encoded as: 00b - power
state D0, 01b - reserved, 10b - reserved, and 11b -
power state D3. Power states D1 and D2 are not
discussed because they have not been imple-
mented as a new feature.
T he Power states--D0 and D3--are described
below in conjunction with each SCSI function.
Power state actions are separate for each function.
Power State D0
Power state D0 is the maximum power state and is
the power-up default state for each function.
Power State D3
Power state D3 is the minimum power state, which
includes subsettings called D3hot and D3cold.
T he devices are considered to be in power state
D3cold when power is removed from them.
D3cold can transition to D0 by applying Vcc and
resetting the device. D3hot allows the device to
transition to D0 via software. To obtain power
reduction in D3hot, the SCSI clock and the SCSI
clock doubler Phase Lock Loop (PLL) are dis-
abled. Furthermore, the function’s soft reset is
continually asserted while in power state D3,
which clears all pending interrupts and tri-states
the SCSI bus. In addition, the function’s PCI com-
mand register is cleared.
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