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參數(shù)資料
| 型號： | SNA7412ZHK |
| 廠商： | TEXAS INSTRUMENTS INC |
| 元件分類： | 總線控制器 |
| 英文描述： | PCMCIA BUS CONTROLLER, PBGA216 |
| 封裝： | GREEN, PLASTIC, MICRO BGA-216 |
| 文件頁數(shù)： | 158/271頁 |
| 文件大?。?/td> | 3240K |
| 代理商： | SNA7412ZHK |
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SD Host Controller Programming Model
224
September 2005
SCPS110
12.18 Power-Management Capabilities Register
The power-management capabilities register indicates the capabilities of the SD host controller related to PCI
power management. See Table 1213 for a complete description of the register contents.
Function 3 register offset: 82h
Register type:
Read/Update, Read-only
Default value:
7E02h
BIT NUMBER
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESET STATE
0
1
0
1
0
Table 1213. Power-Management Capabilities Register Description
BIT
FIELD NAME
TYPE
DESCRIPTION
15
PME_D3COLD
RU
PME support from D3cold. This bit can be set to 1b or cleared to 0b via bit 4 (D3_COLD) in the general
control register at offset 88h in the PCI configuration space (see Section 12.22). When this bit is set
to 1b, it indicates that the SD host controller is capable of generating a PME wake event from D3cold.
This bit state is dependent upon the SD host controller VAUX implementation and may be configured
by using bit 4 (D3_COLD) in the general control register (see Section 12.22).
1411
PME_SUPPORT
R
PME support. This 4-bit field indicates the power states from which the SD host controller may assert
PME. This field returns a value of 1111b by default, indicating that PME may be asserted from the D3hot,
D2, D1, and D0 power states.
10
D2_SUPPORT
R
D2 support. Bit 10 is hardwired to 1b, indicating that the SD host controller supports the D2 power state.
9
D1_SUPPORT
R
D1 support. Bit 9 is hardwired to 1b, indicating that the SD host controller supports the D1 power state.
86
AUX_CURRENT
R
Auxiliary current. This 3-bit field reports the 3.3-VAUX auxiliary current requirements. When bit 15
(PME_D3COLD) is cleared, this field returns 000b; otherwise, it returns 001b.
000b = Self-powered
001b = 55 mA (3.3-VAUX maximum current required)
5
DSI
R
Device-specific initialization. This bit returns 0b when read, indicating that the SD host controller does
not require special initialization beyond the standard PCI configuration header before a generic class
driver is able to use it.
4
RSVD
R
Reserved. Bit 4 returns 0b when read.
3
PME_CLK
R
PME clock. This bit returns 0b when read, indicating that the PCI clock is not required for the SD host
controller to generate PME.
20
PM_VERSION
R
Power-management version.
If bit 7 (PCI_PM_VERSION_CTRL) in the general control register (offset 88h, see Section 12.22) is
0b, this field returns 010b indicating PCI Bus Power Management Interface Specification (Revision 1.1)
compatibility.
If the PCI_PM_VERSION_CTRL bit is 1b, this field returns 011b indicating PCI Bus Power
Management Interface Specification (Revision 1.2) compatibility.
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