參數(shù)資料
型號： S1C33E07B
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 48 MHz, RISC MICROCONTROLLER, PBGA180
封裝： 12 X 12 MM, 1.20 MM HEIGHT, 0.80 MM PITCH, PLASTIC, FBGA-180
文件頁數(shù)： 271/1018頁
文件大?。?/td> 6970K
代理商： S1C33E07B
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18頁
III PERIPHERAL MODULES 1 (SYSTEM): INTERRUPT CONTROLLER (ITC)
S1C33E07 TECHNICAL MANUAL
EPSON
III-2-1
III
ITC
III.2 Interrupt Controller (ITC)
The S1C33E07 contains an interrupt controller, making it possible to control all interrupts generated by the internal
peripheral circuits. This section explains the functions of this interrupt controller centering around the method for
controlling maskable interrupts. For details about the various causes and conditions under which interrupts are
generated, refer to the description of each peripheral circuit in this manual.
III.2.1 Outline of Interrupt Functions
III.2.1.1 Maskable Interrupts
The ITC can handle 55 kinds of maskable interrupts. Table III.2.1.1.1 shows the trap table in the S1C33E07.
Table III.2.1.1.1 Trap Table
IDMA
Ch.
–
1
2
3
4
–
5
6
–
7
8
–
9
10
–
11
12
–
13
14
–
15
16
–
17
18
–
Priority
1
–
4
3
–
2
5
6
–
High
↑
↓
Low
Vector number
(Hex address)
0(Base)
1
2(Base+8)
3(Base+0C)
4–5
6(Base+18)
0x60000
7(Base+1C)
8–10
11(Base+2C)
12(Base+30)
13(Base+34)
14(Base+38)
15(Base+3C)
16(Base+40)
17(Base+44)
18(Base+48)
19(Base+4C)
20(Base+50)
21(Base+54)
22(Base+58)
23(Base+5C)
24(Base+60)
25(Base+64)
26(Base+68)
27–29
30(Base+78)
31(Base+7C)
32–33
34(Base+88)
35(Base+8C)
36–37
38(Base+98)
39(Base+9C)
40–41
42(Base+A8)
43(Base+AC)
44–45
46(Base+B8)
47(Base+BC)
48–49
50(Base+C8)
51(Base+CC)
52–55
Exception/interrupt name
(peripheral circuit)
Reset
reserved
ext exception
Undefined instruction exception
reserved
Address misaligned exception
Debugging exception
NMI
reserved
Illegal interrupt exception
Software exception 0
Software exception 1
Software exception 2
Software exception 3
Port input interrupt 0
Port input interrupt 1
Port input interrupt 2
Port input interrupt 3
Key input interrupt 0
Key input interrupt 1
High-speed DMA Ch.0
High-speed DMA Ch.1
High-speed DMA Ch.2
High-speed DMA Ch.3
Intelligent DMA
reserved
16-bit timer 0
reserved
16-bit timer 1
reserved
16-bit timer 2
reserved
16-bit timer 3
reserved
16-bit timer 4
reserved
16-bit timer 5
reserved
Cause of exception/interrupt
Low input to the reset pin
–
ext instruction (illegal use)
Undefined instruction
–
Memory access instruction
brk instruction, etc.
Low input to the #NMI pin
or watchdog timer overflow
–
Occurrence of illegal interrupt from ITC
int instruction
Edge (rising or falling) or level (High or Low)
Rising or falling edge
High-speed DMA Ch.0, end of transfer
High-speed DMA Ch.1, end of transfer
High-speed DMA Ch.2, end of transfer
High-speed DMA Ch.3, end of transfer
Intelligent DMA, end of transfer
–
Timer 0 compare-match B
Timer 0 compare-match A
–
Timer 1 compare-match B
Timer 1 compare-match A
–
Timer 2 compare-match B
Timer 2 compare-match A
–
Timer 3 compare-match B
Timer 3 compare-match A
–
Timer 4 compare-match B
Timer 4 compare-match A
–
Timer 5 compare-match B
Timer 5 compare-match A
–
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PDF描述
S2973 PIN PHOTO DIODE
S29AL004D90SFI013 256K X 16 FLASH 3V PROM, 90 ns, PDSO48
S29AL008D90MAIR23 8 Megabit (1 M x 8-Bit/512 K x 16-Bit) CMOS 3.0 Volt-only Boot Sector Flash Memory
S29AL008D90MAN012 Ceramic Chip Capacitors / High Voltage; Capacitance [nom]: 150pF; Working Voltage (Vdc)[max]: 500V; Capacitance Tolerance: +/-1%; Dielectric: Multilayer Ceramic; Temperature Coefficient: C0G (NP0); Lead Style: Surface Mount Chip; Lead Dimensions: 0805; Termination: Tin (Sn) Plated Nickel Barrier; Body Dimensions: 0.079" x 0.049"; Container: Bulk; Features: High Voltage; Unmarked
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