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參數(shù)資料
| 型號(hào)： | PNX9520E |
| 廠商： | NXP Semiconductors N.V. |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | Connected media processor |
| 封裝： | PNX9520E/N1<SOT795-1 (BGA456)|<<http://www.nxp.com/packages/SOT795-1.html<1<Always Pb-free,;PNX9520E/N1<SOT795-1 (BGA456)|<<http://www.nxp.com/packages/SOT795-1.html<1 |
| 文件頁數(shù)： | 754/828頁 |
| 文件大?。?/td> | 3775K |
| 代理商： | PNX9520E |
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NXP Semiconductors
PNX15xx/952x Series
Volume 1 of 1
Chapter 26: Memory Arbiter
PNX15XX_PNX952X_SER_N_4
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 4.0 — 03 December 2007
26-778
2.2.1
DCS Gate
The DCS gate is a simple connection between the DCS bus and the Hub. Any 32-bit
write transaction that is in the range of DCS_DRAM_LO to DCS_DRAM_HI causes a
write transaction to main memory via the DCS Gate. This is provided for booting
PNX15xx/952x Series from EEPROM. The DCS_DRAM_LO and DCS_DRAM_HI
registers are located in the Global Registers; see Chapter 3 System On Chip
Resources and Figure 3 on page 3-138 for a simplied block diagram of PNX15xx/
952x Series.
2.3 Arbitration Algorithm
One of the most important purposes of the arbiter is to guarantee a high level of
quality of service to the DMA agents (PNX15xx/952x Series modules). In technical
terms this means:
the ability to guarantee a programmable maximum latency to DMA agents
the ability to guarantee a programmable amount of bandwidth to DMA agents
the ability to provide equal opportunity to DMA agents
any (complex) combination of the three mechanisms mentioned above
The arbiter is not optimized to process requests for memory access from CPUs.
Typically the performance of CPUs depends directly on the access latency to memory
and for this reason they require the lowest possible memory latency. To realize this
CPUs can best get their performance requirements via a private port on a multi-port
memory controller. Therefore, the CPUs are not connected to the arbiter and do not
route memory requests via the Hub.
To support the quality of service features as mentioned above the arbiter algorithm
consists of a combination of three basic arbitration mechanisms. These are:
Time-Division Multiple Access (TDMA) arbitration to guarantee maximum latency
priority arbitration to guarantee bandwidth to reading Soft Real Time DMA (SRT
DMA) agents
round-robin arbitration to guarantee bandwidth to writing SRT DMA agents
round-robin arbitration to provide equal opportunity for Best Effort (BE) DMA
agents
0x3
0xB
SPDI/O, AI/O,
GPIO (r,w)
3 x R, 3 x W
2 x 128-byte buffer
64 Bytes
0x4
0xC
DVDD
1 x R, 1 x W
2 x 256-byte buffer
128 Bytes
0x5
0xD
DCS Gate
1 x W
2 x 32-bit buffer
8 Bytes
0x6:0x7
0xE:0xF
Reserved
Table 1: Peripheral ID and Sub-Arbitration …Continued
TDMA
ID
Modules
DMA
Channels
Buffer size
Transaction
size
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| POE-A | CERAMIC RESONATORS |
| POE-B | CERAMIC RESONATORS |
| POS-50 | VCO, 25 MHz - 50 MHz |
| POS-ED5319/1 | VCO, 75 MHz - 114 MHz |
| PP156TWRG4-6VAC-W12 | DUAL COLOR LED, RED/GREEN, 4 mm |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PNX9520E/N1/S422,5 | 制造商:NXP Semiconductors 功能描述:- Tape and Reel |
| PNY CARRYING CHARGE | 制造商:PNY Technologies 功能描述:PNY CARRYING CHARGE - Virtual or Non-Physical Inventory (Software & Literature) |
| PNY-05015 | 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS |
| PNY-07006 | 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS |
| PNY-12206 | 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS |
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