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參數(shù)資料
| 型號： | PNX9520E |
| 廠商： | NXP Semiconductors N.V. |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Connected media processor |
| 封裝： | PNX9520E/N1<SOT795-1 (BGA456)|<<http://www.nxp.com/packages/SOT795-1.html<1<Always Pb-free,;PNX9520E/N1<SOT795-1 (BGA456)|<<http://www.nxp.com/packages/SOT795-1.html<1 |
| 文件頁數(shù)： | 41/828頁 |
| 文件大?。?/td> | 3775K |
| 代理商： | PNX9520E |
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NXP Semiconductors
PNX15xx/952x Series
Volume 1 of 1
Chapter 3: System On Chip Resources
PNX15XX_PNX952X_SER_N_4
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 4.0 — 03 December 2007
3-135
8.1 Miscellaneous System MMIO registers
Table 9: Miscellaneous System MMIO registers
Bit
Symbol
Acces
s
Value
Description
System Registers
Offset 0x06 3050
PCI_INTA
31:2
Unused
-
To ensure software backward compatibility, writes to unused or
reserved bits should be zero and reads must be ignored.
1
PCI_INTA
W
0x1
Writes PCI_INTA_N pin value if PCI_INTA_OE is enabled
0: PCI_INTA_N is 0 (asserted)
1: PCI_INTA_N is 1 (de-asserted)
To read the PCI_INTA_N pin value use IPENDING MMIO register.
0
PCI_INTA_OE
R/W
0x0
Enable of PCI_INTA_N output
0: Disable PCI_INTA_N output
1: Enable PCI_INTA_N output
Note: In order to operate the PCI_INTA_N pin as an open drain pin
as required by the PCI specication, the software must enable the
output only when driving a ‘0’, i.e. asserting an interrupt.
Note: In order to avoid a race condition between the data and the
enable or glitches on the PCI_INTA_N pin, the enable should only
be changed once the data is stable.
Offset 0x06 3500
SCRATCH0
31:0
SCRATCH0
R/W
-
32-bit writable and readable register. Not cleared at reset for debug
purposes.
Offset 0x06 3504
SCRATCH1
31:0
SCRATCH1
R/W
-
32-bit writable and readable register. Not cleared at reset for debug
purposes.
Offset 0x06 3508
SCRATCH2
31:0
SCRATCH2
R/W
-
32-bit writable and readable register. Not cleared at reset for debug
purposes.
Offset 0x06 350C
SCRATCH3
31:0
SCRATCH3
R/W
-
32-bit writable and readable register. Not cleared at reset for debug
purposes.
Offset 0x06 3510
SCRATCH4
31:0
SCRATCH4
R/W
-
32-bit writable and readable register. Not cleared at reset for debug
purposes.
Offset 0x06 3514
SCRATCH5
31:0
SCRATCH5
R/W
-
32-bit writable and readable register. Not cleared at reset for debug
purposes.
Offset 0x06 3518
SCRATCH6
31:0
SCRATCH6
R/W
-
32-bit writable and readable register. Not cleared at reset for debug
purposes.
Offset 0x06 351C
SCRATCH7
31:0
SCRATCH7
R/W
-
32-bit writable and readable register. Not cleared at reset for debug
purposes.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| POE-A | CERAMIC RESONATORS |
| POE-B | CERAMIC RESONATORS |
| POS-50 | VCO, 25 MHz - 50 MHz |
| POS-ED5319/1 | VCO, 75 MHz - 114 MHz |
| PP156TWRG4-6VAC-W12 | DUAL COLOR LED, RED/GREEN, 4 mm |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PNX9520E/N1/S422,5 | 制造商:NXP Semiconductors 功能描述:- Tape and Reel |
| PNY CARRYING CHARGE | 制造商:PNY Technologies 功能描述:PNY CARRYING CHARGE - Virtual or Non-Physical Inventory (Software & Literature) |
| PNY-05015 | 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS |
| PNY-07006 | 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS |
| PNY-12206 | 制造商:PMI 制造商全稱:PMI 功能描述:OFF-LINE SWITCH MODE TINY SWITCH TRANSFORMERS |
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