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參數(shù)資料
| 型號： | MPC8240 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 322/546頁 |
| 文件大?。?/td> | 5994K |
| 代理商： | MPC8240 |
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8-28
MPC8240 Integrated Processor User's Manual
MOTOROLA
PCI Error Functions
peripheral logic bus. Subsequent processor core accesses to local memory, when LOCK is
asserted, are permitted with the exception that if the processor core attempts to access
addresses within the locked cache line, the MPC8240 will retry the processor until the
locked operation is completed. If a locked operation covers more than one cache line (32
bytes), only the most recently accessed cache line is locked from the processor. Since a
snoop transaction is required to establish a lock, the MPC8240 does not honor the assertion
of LOCK when PICR1[NO_SNOOP_EN] is set.
8.6 PCI Error Functions
PCI provides for parity and other system errors to be detected and reported. This section
describes generation and detection of parity and error reporting for the PCI bus.
The PCI command register and error enabling registers 1 and 2 provide for selective
enabling of speciTc PCI error detection. The PCI status register, error detection registers 1
and 2, the PCI bus error status register, and the 60x/PCI error address register provide PCI
error reporting. These registers are described in Section 5.2, òPCI Interface ConTguration
Registers,ó and Section 5.8, òAddress Map B Options Register.ó
8.6.1 PCI Parity
Generating parity is not optional; it must be performed by all PCI-compliant devices. All
PCI transactions, regardless of type, calculate even parity; that is, the number of 1s on the
AD[31D0], C/BE[3D0], and PAR signals all sum to an even number.
Parity provides a way to determine, on each transaction, if the initiator successfully
addressed the target and transferred valid data. The C/BE[3D0] signals are included in the
parity calculation to insure that the correct bus command is performed (during the address
phase) and that correct data is transferred (during the data phase). The agent responsible for
driving the bus must also drive even parity on the PAR signal one clock cycle after a valid
address phase or valid data transfer, as shown in Figure 8-11.
During the address and data phases, parity covers all 32 address/data signals and the four
command/byte enable signals regardless of whether all lines carry meaningful information.
Byte lanes not actually transferring data must contain stable (albeit meaningless) data and
are included in parity calculation. During conTguration, special-cycle, or interrupt-
acknowledge commands, some address lines are not deTned but are driven to stable values
and are included in parity calculation.
Agents that support parity checking must set the detected parity error bit in the PCI status
register when a parity error is detected. Any additional response to a parity error is
controlled by the parity error response bit in the PCI command register. If the parity error
response bit is cleared, the agent ignores all parity errors.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MPC8260ACZU | MPC826xA (HiP4) Family Hardware Specifications |
| MPC8260CZU | MPC826xA (HiP4) Family Hardware Specifications |
| MPC8264ACZU | MPC826xA (HiP4) Family Hardware Specifications |
| MPC8264AZU | MPC826xA (HiP4) Family Hardware Specifications |
| MPC8264CZU | MPC826xA (HiP4) Family Hardware Specifications |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC8240EC | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Integrated Processor Hardware Specifications |
| MPC8241 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Intergrated Processor Hardware Specifications |
| MPC8241EC | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8241 Integrated Processor Hardware Specifications |
| MPC8241LVR166D | 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MPC8241LVR200D | 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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