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參數(shù)資料
| 型號： | MPC8240 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 32位微處理器（32位微處理器） |
| 文件頁數(shù)： | 109/546頁 |
| 文件大?。?/td> | 5994K |
| 代理商： | MPC8240 |
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MOTOROLA
Chapter 3. Signal Descriptions and Clocking
3-11
Detailed Signal Descriptions
State Meaning
AssertedThe MPC8240 has granted control of the PCI bus to a
requesting master, using the priority scheme described in
Section 8.2, òPCI Bus Arbitrationó. The MPC8240 will assert only
one GNT signal during any clock cycle.
NegatedIndicates that the MPC8240 has not granted control of the
PCI bus and external devices may not initiate a PCI transaction.
3.2.1.5.2 PCI Bus Grant (GNT[4D0])Internal Arbiter Disabled
The MPC8240 PCI arbiter is disabled by a high value on the reset conTguration pin MAA2
or by the clearing of bit 15 of the PCI arbitration control register. In this case, the GNT0
becomes the PCI bus request output for the MPC8240, and it is asserted when the
MPC8240 needs to run a PCI transaction. If the REQ0 input signal is asserted prior to the
need to run a PCI transaction, then the GNT0 signal will not assert (the bus is parked) when
a PCI transaction is to be run. Following is the state meaning for the GNT[4D0] input
signals when the internal arbiter is disabled.
State Meaning
AssertedThe MPC8240 asserts the GNT0 signal as the PCI bus
request output signal. GNT[4D1] signals do not assert in this case.
NegatedThe GNT[4D1] signals are driven high (negated) in this
mode. GNT0 is negated when the MPC8240 is not requesting control
of the PCI bus or the bus is parked on the MPC8240.
3.2.1.6 PCI Bus Request (REQ[4D0])Input
The PCI bus request (REQ[4D0]) signals are inputs on the MPC8240, and they have a
different meaning depending on whether the MPC8240 PCI arbiter is enabled or disabled.
The PCI REQ signals are point-to-point, and every master has its own REQ signal.
3.2.1.6.1 PCI Bus Request (REQ[4D0])Internal Arbiter Enabled
The MPC8240 PCI arbiter is enabled by a low value on the reset conTguration pin MAA2
or by the setting of bit 15 of the PCI arbitration control register. In this case, the REQ[4D0]
signals are used in conjunction with the GNT[4D0] signals as the arbiter for up to Tve PCI
masters. Following is the state meaning for the REQ[4D0] input signals in this case.
State Meaning
AssertedExternal devices are requesting control of the PCI bus.
The MPC8240 acts on the requests as described in Section 8.2, òPCI
Bus Arbitration.ó
NegatedIndicates that no external devices are requesting the use of
the PCI bus.
3.2.1.6.2 PCI Bus Request (REQ[4D0])Internal Arbiter Disabled
The MPC8240 PCI arbiter is disabled by a high value on the reset conTguration pin MAA2
or by the clearing of bit 15 of the PCI arbitration control register. In this case, the REQ0
becomes the PCI bus grant input for the MPC8240, and it is asserted when the external
arbiter is granting the use of the PCI bus to the MPC8240. Note that if the REQ0 input
signal is asserted prior to the need to run a PCI transaction, then the MPC8240 GNT0 signal
will not assert (the bus is parked) when a PCI transaction is to be run.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| MPC8241EC | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:MPC8241 Integrated Processor Hardware Specifications |
| MPC8241LVR166D | 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MPC8241LVR200D | 功能描述:微處理器 - MPU INTEGRATED HOST PROC RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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