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參數(shù)資料
| 型號： | GC4116 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | MULTI-STANDARD QUAD DUC CHIP |
| 中文描述： | 多標準四數(shù)字上芯片 |
| 文件頁數(shù)： | 8/57頁 |
| 文件大?。?/td> | 401K |
| 代理商： | GC4116 |
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GC4116 MULTI-STANDARD QUAD DUC CHIP
DATA SHEET REV 1.0
19992001
GRAYCHIP,INC.
- 3 -
APRIL 27, 2001
This document contains preliminary information which may be changed at any time without notice
Figure 2. Normal Control I/O Timing
CE
WR
RD
C[0-7]
A[0-4]
t
REC
t
CDLY
t
CSU
t
CZ
READ CYCLE- NORMAL MODE
CE
WR
RD
C[0-7]
A[0-4]
t
REC
t
CSPW
t
CSU
t
CHD
WRITE CYCLE- NORMAL MODE
WR
CE
C[0-7]
A[0-4]
t
CDLY
t
CSU
t
CZ
CE
WR
C[0-7]
A[0-4]
t
CSPW
t
CSU
t
CHD
READ CYCLE-
RD
HELD LOW
WRITE CYCLE-
RD
HELD LOW
t
REC
t
REC
t
REC
t
REC
t
REC
t
REC
t
CSU
t
CSU
The edge write mode, enabled by the
pin, allows for rising edge write cycles. In this mode the data
on the
C[0:7]
pins only need to be stable for a small setup
time before the rising edge of the write strobe, and held for a
small hold time afterwards. This mode is appropriate for
processors that do not provide stable data before the start of
the write pulse. Figure 3 shows the timing for this mode.
WRMODE
input
The setup, hold and pulse width requirements for control
read or write operations are given in Section 6.0.
Figure 3. Edge Write Control Timing
CE
WR
RD
C[0-7]
A[0-4]
t
REC
t
CSPW
t
CSU
t
CHD
EDGE WRITE MODE
t
REC
t
CSU
t
CSU
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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