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參數(shù)資料
| 型號： | FDC37C666GT |
| 廠商： | STANDARD MICROSYSTEMS CORP |
| 元件分類： | 存儲(chǔ)控制器/管理單元 |
| 英文描述： | High-Performance Multi-Mode Parallel Port Super I/O Floppy Disk Controllers |
| 中文描述： | 1 Mbps, IDE COMPATIBLE, FLOPPY DISK DRIVE CONTROLLER, PQFP100 |
| 封裝： | QFP-100 |
| 文件頁數(shù)： | 99/152頁 |
| 文件大?。?/td> | 621K |
| 代理商： | FDC37C666GT |
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99
Table 40 - EPP Pin Descriptions
TYPE
EPP
SIGNAL
nWRITE
PD<0:7>
INTR
EPP NAME
EPP DESCRIPTION
nWrite
Address/Data
Interrupt
O
I/O
I
This signal is active low. It denotes a write operation.
Bi-directional EPP byte wide address and data bus.
This signal is active high and positive edge triggered. (Pass
through with no inversion, Same as SPP.)
This signal is active low. It is driven inactive as a positive
acknowledgement from the device that the transfer of data
is completed. It is driven active as an indication that the
device is ready for the next transfer.
This signal is active low. It is used to denote data read or
write operation.
This signal is active low. When driven active, the EPP
device is reset to its initial operational mode.
This signal is active low. It is used to denote address read
or write operation.
Same as SPP mode.
Same as SPP mode.
nWAIT
nWait
I
nDATASTB
nData Strobe
O
nRESET
nReset
O
nADDRSTB
nAddress
Strobe
Paper End
Printer
Selected
Status
nError
Parallel Port
Direction
O
PE
SLCT
I
I
nERR
PDIR
I
Same as SPP mode.
This output shows the direction of the data transfer on the
parallel port bus. A low means an output/write condition
and a high means an input/read condition. This signal is
normally a low (output/write) unless PCD of the control
register is set or if an EPP read cycle is in progress.
O
Note 1: SPP and EPP can use 1 common register.
Note 2: nWrite is the only EPP output that can be over-ridden by SPP control port during an EPP
cycle. For correct EPP read cycles, PCD is required to be a low.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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