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參數(shù)資料
| 型號： | FDC37C666GT |
| 廠商： | STANDARD MICROSYSTEMS CORP |
| 元件分類： | 存儲控制器/管理單元 |
| 英文描述： | High-Performance Multi-Mode Parallel Port Super I/O Floppy Disk Controllers |
| 中文描述： | 1 Mbps, IDE COMPATIBLE, FLOPPY DISK DRIVE CONTROLLER, PQFP100 |
| 封裝： | QFP-100 |
| 文件頁數(shù)： | 121/152頁 |
| 文件大?。?/td> | 621K |
| 代理商： | FDC37C666GT |
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121
CR1
This register can only be accessed when the
FDC is in the Configuration Mode and after the
CSR has been initialized to 01H. The default
value of this register after power up is 9FH.
Table 48 - CR1
DESCRIPTION
These bits are used to select the Parallel Port Address.
1 0 Parallel Port Address
0 0 Disabled
0 1 3BCH
1 0 378H
1 1 278H (Default)
A high level on this bit, supplies power to the Parallel Port
(Default). A low level on this bit puts the Parallel Port in low
power mode.
Parallel Port Mode. A high level on this bit, sets the Parallel Port
for Printer Mode (Default). A low level on this bit enables the
Extended Parallel port modes. Refer to Bits 0 and 1 of CR4
A high level on this bit, programs IRQ3, IRQ4, FINTR and
(PINTR) for active high, inactive low (Default). A low level on
this bit programs IRQ3, IRQ4, FINTR and (PINTR) for active
low, inactive hi-Z. (See Note CR1_1)
Select the COM3 and COM4 address.
BIT NO.
0,1
BIT NAME
Parallel Port
Address
2
Parallel Port
Power
3
Parallel Port
Mode
4
IRQ Polarity
5,6
COM3,4
6 5 COM3 COM4
0 0 338H 238H (Default)
0 1 3E8H 2E8H
1 0 2E8H 2E0H
1 1 220H 228H
A high level on this bit enables the reading and writing of CR0-
CRF (Default). A low level on this bit disables the reading and
writing of CR0-CRF. Once set to 0, this bit can only be set to 1
by a hard reset or power-up reset.
7
LOCK CRx
Note CR1_1: If the parallel port is configured for ECP or EPP modes, then PINTR is always active
low, inactive hi-z independent of this bit.
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