參數(shù)資料
型號： EVAL-ADUC7036QSPZ
廠商： Analog Devices Inc
文件頁數(shù)： 68/132頁
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描述： BOARD EVAL FOR ADUC7036
設(shè)計資源： EVAL-ADUC7036 Schematic & Brd Outline
EVAL ADUC7036 Gerber Files
標(biāo)準(zhǔn)包裝： 1
系列： QuickStart™ PLUS 套件
主要目的： 電源管理，電池監(jiān)控器
嵌入式： 是，MCU，16/32 位
已用 IC / 零件： ADuC7036
已供物品： 板，線纜，文檔，仿真器，電源，軟件
ADuC7036
Rev. C | Page 40 of 132
Table 27. STI Base Address = 0xFFFF0880
Address
Name
Byte
Access
Type
Default
Value
Description
0x0880
STIKEY0
4
W
N/A
STICON prewrite key. See the Serial Test Interface Key0 Register section.
0x0884
STICON
2
RW
0x0000
Serial test interface control MMR. See the Serial Test Interface Control Register
section and Table 91.
0x0888
STIKEY1
4
W
N/A
STICON postwrite key. See the Serial Test Interface Key1 Register section.
0x088C
STIDAT0
2
RW
0x0000
STI Data MMR 0. See the Serial Test Interface Data0 Register section.
0x0890
STIDAT1
2
RW
0x0000
STI Data MMR 1. See the Serial Test Interface Data1 Register section.
0x0894
STIDAT2
2
RW
0x0000
STI Data MMR 2. See the Serial Test Interface Data2 Register section.
Table 28. SPI Base Address = 0xFFFF0A00
Address
Name
Byte
Access
Type
Default
Value
Description
0x0A00
SPISTA
1
R
0x00
SPI status MMR. See the SPI Status Register section and Table 90.
0x0A04
SPIRX
1
R
0x00
SPI receive MMR. See the SPI Receive Register section.
0x0A08
SPITX
1
W
N/A
SPI transmit MMR. See the SPI Transmit Register section.
0x0A0C
SPIDIV
1
RW
0x1B
SPI baud rate select MMR. See the SPI Divider Register section.
0x0A10
SPICON
2
RW
0x0000
SPI control MMR. See the SPI Control Register section and Table 89.
Table 29. GPIO Base Address = 0xFFFF0D00
Address
Name
Byte
Access
Type
Default
Value
Description
0x0D00
GP0CON
4
RW
0x11100000
0x0D04
GP1CON
4
RW
0x10000000
0x0D08
GP2CON
4
RW
0x01000000
0x0D20
4
RW
0x000000XX
GPIO Port0 data control MMR. See the GPIO Port0 Data Register section and Table 62.
0x0D24
4
W
N/A
GPIO Port0 data set MMR. See the GPIO Port0 Set Register section and Table 65.
0x0D28
4
W
N/A
GPIO Port0 data clear MMR. See the GPIO Port0 Clear Register section and Table 68.
0x0D30
4
RW
0x000000XX
GPIO Port1 data control MMR. See the GPIO Port1 Data Register section and Table 63.
0x0D34
4
W
N/A
GPIO Port1 data set MMR. See the GPIO Port1 Set Register section and Table 66.
0x0D38
4
W
N/A
GPIO Port1 data clear MMR. See the GPIO Port1 Clear Register section and Table 69.
0x0D40
4
RW
0x000000XX
GPIO Port2 data control MMR. See the GPIO Port2 Data Register section and Table 64.
0x0D44
GP2SET
4
W
N/A
GPIO Port2 data set MMR. See the GPIO Port2 Set Register section and Table 67.
0x0D48
GP2CLR
4
W
N/A
GPIO Port2 data clear MMR. See the GPIO Port2 Clear Register section and Table 70.
1 Depends on the level on the external GPIO pins.
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PDF描述
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參數(shù)描述
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