參數(shù)資料
型號： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 563/784頁
文件大小： 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
563
Agere Systems Inc.
22 Cross Connect (XC) Block Functional Description
(continued)
The concentration highway interface can operate at data rates of 2.048 Mbits/s, 4.096 Mbits/s, and 8.192 Mbits/s.
The CHI interface allows a single system interface to support combining two or four DS1/E1s at 4.096 Mbits/s and
8.192 Mbits/s, respectively. Therefore, the 28-channel framer block may result in as many as 28 CHIs or as few as
seven combined CHIs, or a mix as determined by the specific needs of the application.
In addition to configuring the framers for the CHI mode, seven CHI mode parameters in the cross connect block
require configuration. The parameters are designated XC_CHI_MODE[1—7][1:0] (
Table 462 on page 327
). The
parameters divide the 28-framer CHI system interfaces, LINETXSYNC[1—29], into seven groups of four, LINETX-
SYNC[1—4], . . . , LINETXSYNC[25—28]. Each XC_CHI_MODE[1—7][1:0] parameter consists of 2 bits for config-
uration of the control group see
Table 630
.
Table 630. Configuration of the Control Group
For example, XC_CHI_MODE[4][1:0] = 01 configures LINETXSYNC[13] and LINETXSYNC[14] as individual
2.048 Mbits/s CHIs and combines LINETXSYNC[16] and LINETXSYNC[15] into a 4.096 Mbits/s output on
LINETXSYNC[16]. The LINETXSYNC[15] output can be used for T1/E1 line sync output.
5-9186(F)r.3
* See
Table 462 on page 327
.
Figure 88. Framer System Interface—Concentration Highway Interface (CHI)
XC_CHI_MODE[1
—
7][1:0]
00
01
Description
All four links within the group are normal outputs at 2 Mbits/s or 4 Mbits/s.
Links 4i – 3 and 4i – 2 are normal outputs; links 4i – 1 and 4i are combined into a
single output on 4i; output 4i – 1 is used as T1/E1 line output, where i = 1 to 7.
Links 4i – 1 and 4i are combined into a single output on 4i; links 4i – 3 and 4i – 2 are
combined into a single output on 4i – 2; outputs 4i – 1 and 4i – 3 are used as T1/E1
line outputs.
All four links are combined into a single output on 4i; the other three outputs are
used as T1/E1 line outputs.
10
11
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! "#
"
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Σ
Σ
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
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TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
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參數(shù)描述
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