參數(shù)資料
型號(hào)： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁(yè)數(shù)： 296/784頁(yè)
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
296
Agere Systems Inc.
12 28-Channel Framer Registers
(continued)
Table 424. FRM_TFDLLR6, Transmit FDL Link Register 6 (R/W)
* See
Table 422 on page 295
for values of L and T.
Address
*
Bit
Name
Function
Reset
Default
0x0
0
0x8LTD5
15:8
7
RSVD
Reserved.
Must write to 0.
Sa8 Source Control.
A 1 indicates that Sa8 is sourced from the
TXFDL stack. Zero indicates that Sa8 is sourced from the time
slot 0 data of the system interface in switching mode, or from
time slot 0 data received by the transmit path receive aligner in
transparent mode.
Sa7 Source Control.
A 1 indicates that Sa7 is sourced from the
TXFDL stack. Zero indicates that Sa7 is sourced from the time
slot 0 data of the system interface in switching mode, or from
time slot 0 data received by the transmit path receive aligner in
transparent mode.
Sa6 Source Control.
A 1 indicates that Sa6 is sourced from the
TXFDL stack. Zero indicates that Sa6 is sourced from the time
slot 0 data of the system interface in switching mode, or from
time slot 0 data received by the transmit path receive aligner in
transparent mode.
Sa5 Source Control.
A 1 indicates that Sa5 is sourced from the
TXFDL stack. Zero indicates that Sa5 is sourced from the time
slot 0 data of the system interface in switching mode, or from
time slot 0 data received by the transmit path receive aligner in
transparent mode.
Sa4 Source Control.
A 1 indicates that Sa4 is sourced from the
TXFDL stack. Zero indicates that Sa4 is sourced from the time
slot 0 data of the system interface in switching mode, or from
time slot 0 data received by the transmit path receive aligner in
transparent mode.
FRM_TXCRCSM
CEPT CRC-4 Stack Mode.
When set to 0, the Sa bits will be
transmitted based on being active. If MFA is lost, the stack will
not be transmitted. When set to 1, the Sa bits will be transmitted
based on BFA (basic frame alignment) only.
FRM_ASRC
Alignment Source.
A 1 indicates that the MFA and BFA will be
used to determine if a BOM or stack is transmitted. A 0 indicates
that, when enabled for insertion, BOMs and stacks will be
inserted whenever the TDM data is requested.
FRM_DS1I
DS1 Insertion.
A 1 enables this block to insert the contents of
the stack into the associated DS1 link. For
SLC
-96 links, D bits
will be inserted given the associated stack format. For DDS
links, data-link bits will be inserted given the associated stack
format. For other DS1 link types, this bit has no effect. A 0 dis-
ables this block from inserting D bits or data link bits into the
associated link.
FRM_SA8SC
6
FRM_SA7SC
0
5
FRM_SA6SC
0
4
FRM_SA5SC
0
3
FRM_SA4SC
0
2
0
1
0
0
0
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
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TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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