參數(shù)資料
型號(hào)： TFRA28J133BAL-1
元件分類(lèi)： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁(yè)數(shù)： 269/784頁(yè)
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
269
Agere Systems Inc.
12 28-Channel Framer Registers
(continued)
Table 376. FRM_SGR6, Receive Signaling Global Register 6
Table 377. FRM_SGR7, Receive Signaling Global Register 7 (R/W)
Address
Bit
Name
Function
Reset
Default
0
0
0x80065
15:3
2
RSVD
Reserved.
Reads 0.
Receive Signaling Change of State FIFO Depth Thresh-
old Overflow Interrupt.
This interrupt status bit will be set
when the programmed threshold for the FIFO capacity has
been exceeded. This interrupt bit can be reset based on a
clear-on-read protocol, which is provisioned in the Super-
mapper global registers.
Receive Signaling Change of State FIFO Timer Thresh-
old Interrupt.
This interrupt status bit will be set when the
programmed interrupt timer has expired and there are valid
entries in the FIFO to be processed. This interrupt bit can be
reset based on a clear-on-read protocol, which is provisioned
in the Supermapper global registers.
Receive Signaling Change of State FIFO Overflow Inter-
rupt.
This interrupt status bit will be set when the signaling
change of state FIFO overflows. The contents of the FIFO
will be lost and the programmed threshold for the FIFO
capacity has been exceeded. This interrupt bit can be reset
based on a clear-on-read protocol, which is provisioned in
the Supermapper global registers.
FRM_R_COSDTHI
1
FRM_R_COSTTHI
0
0
FRM_R_COSOFI
0
Address
Bit
Name
Function
Reset
Default
0
1
0x80066
15:3
2
RSVD
Reserved.
Reads 0.
FRM_R_COSDTHM
Receive Signaling Change of State FIFO Depth Thresh-
old Overflow Interrupt Mask.
The corresponding interrupt
status bit will cause a processor interrupt if this bit is set to 0.
The corresponding interrupt status bit will be masked from
causing a processor interrupt if this bit is set to 1.
FRM_R_COSTTHM
Receive Signaling Change of State FIFO Timer Thresh-
old Interrupt Mask.
The corresponding interrupt status bit
will cause a processor interrupt if this bit is set to 0. The cor-
responding interrupt status bit will be masked from causing a
processor interrupt if this bit is set to 1.
FRM_R_COSOFM
Receive Signaling Change of State FIFO Overflow Inter-
rupt Mask.
The corresponding interrupt status bit will cause
a processor interrupt if this bit is set to 0. The corresponding
interrupt status bit will be masked from causing a processor
interrupt if this bit is set to 1.
1
1
0
1
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱(chēng):AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱(chēng):AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱(chēng):AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱(chēng):AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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