參數(shù)資料
型號(hào)： TFRA28J133BAL-1
元件分類： TVS-瞬態(tài)抑制二極管
英文描述： Transient Voltage Suppressor Diodes
中文描述： 電信提供商/數(shù)據(jù)通信
文件頁數(shù)： 418/784頁
文件大?。?/td> 10831K
代理商： TFRA28J133BAL-1
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
418
Agere Systems Inc.
18 SPE Mapper Functional Description
(continued)
I
SPE_J1MONMODE[2:0] = 101: the user will program the 16 expected values of J1 in
SPE_RJ1DEXP[1—16][7:0] in SDH framing mode, where the first byte of the message has the MSB set to 1.
The SPE mapper performs a byte-by-byte comparison of the incoming J1 sequence with the stored expected
value. If different, the SPE will set the SPE_RTIM state bit. Any change in state is reported in bit SPE_RTIMD,
using interrupt mask bit SPE_RTIMM.
I
SPE_J1MONMODE[1:0] = 110 and 111 are currently undefined.
I
Unless bit PAIS_TIMINH (
Table 159 on page 141
) is set, bit SPE_RTIMD contributes to the AUTO AIS control
signal from the SPE mapper to the VT mapper.
I
Unless mask bit SPE_RTIMM is set, bit SPE_RTIMD can generate an interrupt.
Table 548. J1 Monitor
18.14.3 B3 BIP-8 Check
A B3 BIP-8 even parity is computed over all the incoming bits of the TUG-3 frame, after descrambling, and com-
pared to the B3 byte received in the next frame. The total number of B3 BIP-8 bit errors (raw count) or block errors
is counted (selected through SPE_B3BITBLKCNT (
Table 159 on page 141
)). Upon a performance monitor (PM)
interval, the internal running counter is placed into SPE_B3ECNT[15:0] (
Table 170 on page 150
) and then cleared.
Depending on the value of microprocessor bit SMPR_SAT_ROLLOVER (
Table 77 on page 70
), the internal
counter will roll over or stay at its maximum value until cleared.
18.14.4 Signal Label C2 Byte Monitor
Table 549. STS Signal Label Defect Conditions
Name
Function
SPE_J1MONMODE[2:0] (
Table 159 on page 141
)
SPE_RJ1DEXP[1—64][7:0] (
Table 174 on page 151
)
SPE_RJ1DMON[1—64][7:0] (
Table 172 on page 151
)
SPE_CNTDJ1[3:0] (
Table 160 on page 142
)
SPE_RTIM (
Table 158 on page 140
)
SPE_RTIMD (
Table 156 on page 136
)
SPE_RTIMM (
Table 157 on page 138
)
J1 Monitoring Type.
J1 Expected Data Storage (64/1 Byte).
J1 Received Data Storage (64/1 Byte).
Continuous Times Detect Value.
J1 Mismatch State Bit.
J1 Mismatch Delta Bit, Active-High.
J1 Mismatch Mask Bit, Active-High.
Provisioned STS PTE
Functionality, Expected C2
Any Equipped Functionality
Any Equipped Functionality
Equipped—Nonspecific
Any Payload Specific Code
Received Payload Label
(C2 in hex)
Unequipped (00)
Equipped—Nonspecific (01)
Any Value (02 to E0, FD to FE)
The Same Payload Specific
Code (02 to E0, FD to FE)
A Different Payload Specific
Code (02 to E0, FD to FE)
PDI, 1 to 27 VTx Defects
(E1 to FB)
PDI, 1 to 27 VTx Defects
(E1 to FB)
Defect
TMUX_FORCEC2DEF = 1
(
Table 107 on page 99
)
No Change
No Change
No Change
No Change
TMUX_RUNEQP
None
None
None
Any Payload Specific Code
TMUX_RPLMP
No Change
Equipped—Nonspecific (01) or
VT-Structured STS-1 (02)
Any Payload Specific Code
Except VT-Structured
STS-1 (02)
Any Equipped Functionality
None
TMUX_RPLMP
TMUX_RPLMP
No Change
PDI, 28 VT1.5 Defects or 1
Non-VT Payload Defect (FC)
Reserved (FF)
None
TMUX_RPLMP
Any Equipped Functionality
None
TMUX_RPLMP
相關(guān)PDF資料
PDF描述
TN0200T-T1 CA DUAL BANANA/DUAL BANANA 5'
TN0201T-T1 TRANSISTOR SOT23 SMD MOSFET
TN0520N3 TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92
TN0524N3 TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92
TN0540N3 TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
TFRA84J13 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J131BL-3-DB 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA
TFRA84J13DS0 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS1 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
TFRA84J13DS2 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
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