參數(shù)資料
型號(hào)： ST7FLCD1G9M1
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 24 MHz, MICROCONTROLLER, PDSO28
封裝： ROHS COMPLIANT, SO-28
文件頁(yè)數(shù)： 36/96頁(yè)
文件大?。?/td> 846K
代理商： ST7FLCD1G9M1
ST7FLCD1
I/O Ports
7.6
Port D
The alternate functions are:
● the I/O pins of the on-chip IC SCLI & SDAI for PD[1:0],
● the I/O pins of the on-chip DDC A SCLD & SDAD for PD[3:2],
● the I/O pins of the on-chip DDC B SCLD & SDAD for PD[5:4]
● input and output on PD[7:6].
Figure 21: Port C
Table 14: Port D Description
PORT D
I / O
Alternate Function
Input1
1. Reset state.
Output
Signal
Condition
PD0
Without Pull-up
Open-drain
SCLI (input with TTL Schmitt trigger or Open-drain output)
IC enable
PD1
Without Pull-up
Open-drain
SDAI (input with TTL Schmitt trigger or Open-drain output)
IC enable
PD2
Without Pull-up
Open-drain
SCLD A (input with TTL Schmitt trigger or Open-drain output)
DDC A enable
PD3
Without Pull-up
Open-drain
SDAD A (input with TTL Schmitt trigger or Open-drain output)
DDC A enable
PD4
Without Pull-up
Open-drain
SCLD B (input with TTL Schmitt trigger or Open-drain output)
DDC B enable
PD5
Without Pull-up
Open-drain
SDAD B (input with TTL Schmitt trigger or Open-drain output)
DDC B enable
PD6
Without Pull-up
Open-drain
PD7
Without Pull-up
Open-drain
DA
T
A
B
U
S
DR SEL
DDR SEL
1
0
TTL Schmitt Trigger
DR
DDR
Latch
VSS
VDD
相關(guān)PDF資料
PDF描述
ST7FLIT19BF1U6TR 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, QCC20
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ST7LNB0V2Y0M6 8-BIT, 8 MHz, MICROCONTROLLER, PDSO16
ST7LNB1Y0M6 8-BIT, EEPROM, 8 MHz, MICROCONTROLLER, PDSO16
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參數(shù)描述
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