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參數(shù)資料
| 型號： | SAA7392 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Channel encoder/decoder CDR60(通道編碼器/譯碼器) |
| 中文描述： | 信道編碼器/解碼器CDR60（通道編碼器/譯碼器） |
| 文件頁數(shù)： | 56/76頁 |
| 文件大?。?/td> | 246K |
| 代理商： | SAA7392 |
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2000 Mar 21
56
Philips Semiconductors
Preliminary specification
Channel encoder/decoder CDR60
SAA7392
7.16.2
EFM C
LOCK
C
ONFIGURATION
R
EGISTER
2 (EFMC
LOCK
C
ONF
2)
Table 124
EFM Clock Configuration Register 2 (address 35H) - WRITE
Table 125
Description of EFMClockConf2 bits
Table 126
Selection of PLL frequency source
Table 127
Selection of position source
Table 128
Digital PLL multiplication factor
7
6
5
4
3
2
1
0
FreqSrc.1
FreqSrc.0
PosSrc.1
PosSrc.0
DPLLMF.3
DPLLMF.2
DPLLMF.1
DPLLMF.0
BIT
SYMBOL
DESCRIPTION
7
6
5
4
3
2
1
0
FreqSrc.1
FreqSrc.0
PosSrc.1
PosSrc.0
DPLLMF.3
DPLLMF.2
DPLLMF.1
DPLLMF.0
These 2 bits select the frequency source for the PLL; see Table 126.
These 2 bits select the position source; see Table 127.
These 4 bits select the multiplication factor for the PLL; see Table 128
FreqSrc.1
FreqSrc.0
FREQUENCY SOURCE
0
0
PLL locks to W441. Use this signal as frequency source to lock EFM frequency to disc
wobble.
PLL locks to WCLK. Use this signal if encoding must slave to the word clock of some
external I
2
S/EBU input.
PLL locks to sysclock/192
This setting is reserved.
0
1
1
1
0
1
PosSrc.1
PosSrc.0
POSITION SOURCE
0
1
0
0
No position error used.
Position source is XError<6:0>. Use this source if EFM clock is locked to ATIP carrier
(W441).
Position source is FifoFill<6:0>. Use this source is EFM clock is locked to WCLK signal.
All other combinations are reserved.
1
X
1
X
DPLLMF.3
DPLLMF.2
DPLLMF.1
DPLLMF.0
DIGITAL PLL MULTIPLICATION FACTOR
0
0
0
0
0
1
1
0
0
0
1
1
0
0
0
0
1
0
1
0
1
0
1
0
0
0
0
0
294
196
147
98
73.5
49
36.75
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