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參數(shù)資料
| 型號(hào)： | PSD833F2-15M |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 1M X 1 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52 |
| 封裝： | PLASTIC, QFP-52 |
| 文件頁數(shù)： | 49/122頁 |
| 文件大?。?/td> | 489K |
| 代理商： | PSD833F2-15M |
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The
PSD8XXF
Functional
Blocks
(cont.)
Level 1
SRAM, I /O, or
Peripheral I /O
Level 2
Flash Boot Memory
Highest Priority
Lowest Priority
Level 3
Main Flash Memory
Figure 5. Priority Level of Memory and I/O Components
9.1.3.1. Memory Select Configuration for MCUs with Separate Program and Data Spaces
The 8031 and compatible family of microcontrollers, which includes the 80C51, 80C151,
80C251, and 80C51XA, have separate address spaces for code memory (selected using
PSEN) and data memory (selected using RD). Any of the memories within the PSD8XXF
can reside in either space or both spaces. This is controlled through manipulation of the
VM register that resides in the PSD’s CSIOP space.
The VM register is set using PSDsoft to have an initial value. It can subsequently be
changed by the microcontroller so that memory mapping can be changed on-the-fly.
For example, you may wish to have SRAM and Flash in Data Space at boot, and Boot
Block in Program Space at boot, and later swap Boot Block and Flash. This is easily done
with the VM register by using PSDsoft Configuration to configure it for boot up and having
the microcontroller change it when desired.
Table 13 describes the VM Register.
Bit 7
Bit 6* Bit 5*
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
PIO_EN
FL_Data Boot_Data
FL_Code
Boot_Code SRAM_Code
0 = disable
**
0 = RD
0 = PSEN
PIO mode
can’t
access
Flash
Boot Flash
Flash
Boot Flash
SRAM
1= enable
**
1 = RD
1 = PSEN
PIO mode
access
Flash
Boot Flash
Flash
Boot Flash
SRAM
Table 13. VM Register
NOTE: Bits 6-5 are not used.
PSD8XXF Family
Preliminary Information
28
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