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參數(shù)資料
| 型號： | MT90812 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | Integrated Digital Switch (IDX)(集成數(shù)字開關(guān)) |
| 中文描述： | 綜合數(shù)字交換機（IDX的）（集成數(shù)字開關(guān)） |
| 文件頁數(shù)： | 72/105頁 |
| 文件大?。?/td> | 334K |
| 代理商： | MT90812 |
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MT90812
Advance Information
68
22.23
D-Channel BR Status (DRXS)
The register is configured as follows:
22.24
D-Channel RX FIFO Output (DRXOUT)
The register is configured as follows:
The receiver transfers incoming data for a specified channel to the RX FIFO. The D-Channel RX channel is
identified in address 70
HEX
of Connect Memory Low (refer to Section 5.3). The data in this channel is
transferred to the RX FIFO buffer. A read of control register D-Channel RX FIFO Output (DRXOUT) at 43
HEX
accesses the next data byte in the RX FIFO buffer.
22.25
D-Channel TX FIFO Input (DTXIN)
The register is configured as follows:
Read Address is: 42
H
Reset Value is: 00
H
Bit
Name
Description
7-3
-
Unused
.
2
OE
RX Overrun Error
. Gets set when writing to a full FIFO.
1
PE
RX Parity Error
.
0
SE
RX Stop bit Error
.
Read Address is: 43
H
Bit
Name
Description
7-0
D7-D0
Next data byte in the RX FIFO buffer
. D7 is the MSB.
Write Address is: 44
H
Bit
Name
Description
7-0
D7-D0
TX FIFO buffer
. D7 is the MSB.
7
6
5
4
3
2
1
0
OV
PE
SE
-
-
-
-
-
7
6
5
4
3
2
1
0
D2
D1
D0
D4
D3
D7
D6
D5
7
6
5
4
3
2
1
0
D2
D1
D0
D4
D3
D7
D6
D5
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT90840AK | Distributed Hyperchannel Switch |
| MT90840AP | Distributed Hyperchannel Switch |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MT90812AP1 | 制造商:Zarlink Semiconductor Inc 功能描述:SWIT FABRIC 192 X 192 16.384MBPS 5V 68PLCC /BAKE/DRYPACK - Rail/Tube 制造商:Zarlink Semiconductor Inc 功能描述:INTEGRATED DIGITAL SWCH |
| MT90812APR | 制造商:Microsemi Corporation 功能描述:SWIT FABRIC 192 X 192/64 X 64 1.048GBPS 5V 68PLCC - Tape and Reel |
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