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參數(shù)資料
| 型號： | DS3164N |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 342/384頁 |
| 文件大小： | 0K |
| 描述： | IC QUAD ATM/PACKET PHY 400-PBGA |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 1 |
| 類型： | PHY 收發(fā)器 |
| 應用： | 測試設備 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 400-BBGA |
| 供應商設備封裝： | 400-PBGA（27x27） |
| 包裝： | 托盤 |
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DS3161/DS3162/DS3163/DS3164
PIN
TYPE
FUNCTION
GPIO2
I/O
General-Purpose I/O 2
GPIO2: This signal is configured to be a general-purpose I/O pin, or the 8KREFO
output signal, or an alarm output signal for port 1.
GPIO3
I/O
General-Purpose I/O 3
GPIO3: This signal is configured to be a general-purpose I/O pin, or an alarm output
signal for port 2.
GPIO4
I/O
General-Purpose I/O 4
GPIO4: This signal is configured to be a general-purpose I/O pin, or the 8KREFI input
signal, or an alarm output signal for port 2. When configured for 8KREFI mode the
signal frequency should be 8,000 Hz ±500ppm and about 50% duty cycle.
GPIO5
I/O
General-Purpose I/O 5
GPIO5: This signal is configured to be a general-purpose I/O pin, or an alarm output
signal for port 3.
GPIO6
I/O
General-Purpose I/O 6
GPIO6: This signal is configured to be a general-purpose I/O pin, or the TMEI input
signal, or an alarm output signal for port 3. When configured for TMEI input, the signal
low time and high time must be greater than 500ns.
GPIO7
I/O
General-Purpose I/O 7
GPIO7: This signal is configured to be a general-purpose I/O pin, or an alarm output
signal for port 4.
GPIO8
I/O
General-Purpose I/O 8
GPIO8: This signal is configured to be a general-purpose I/O pin, or the PMU input
signal, or an alarm output signal for port 4. When configured for PMU input, the
signal low time and high time must be greater than 500 ns.
TEST
I
Test enable (active low)
TEST: This signal enables the internal scan test mode when low. For normal operation
tie high. This is an asynchronous input.
HIZ
I
High-impedance test enable (active low)
HIZ: This signal puts all digital output and bi-directional pins in the high-impedance
state when it low and
JTRST is low. For normal operation tie high. This is an
asynchronous input.
RST
I
Reset (active low)
RST: This signal resets all the internal processor registers and logic when low. This
pin should be low while power is applied and set high after the power is stable. This
is an asynchronous input.
JTAG
JTCLK
I
JTAG Clock
JTCLK: This clock input is typically a low frequency (less than 10MHz) 50% duty
cycle clock signal.
JTMS
Ipu
JTAG Mode Select (with pullup)
JTMS: This input signal is used to control the JTAG controller state machine and is
sampled on the rising edge of JTCLK.
JTDI
Ipu
JTAG Data Input (with pullup)
JTDI: This input signal is used to input data into the register that is enabled by the
JTAG controller state machine and is sampled on the rising edge of JTCLK.
JTDO
Oz
JTAG Data Output
JTDO: This output signal is the output of an internal scan shift register enabled by the
JTAG controller state machine and is updated on the falling edge of JTCLK. The pin
is in the high-impedance mode when a register is not selected or when the
JTRST
signal is high. The pin goes into and exits the high-impedance mode after the falling
edge of JTCLK
相關PDF資料 |
PDF描述 |
|---|---|
| AMC22DRYN-S93 | CONN EDGECARD 44POS DIP .100 SLD |
| AMC22DRYH-S93 | CONN EDGECARD 44POS DIP .100 SLD |
| 24LC00-I/SN | IC EEPROM 128BIT 400KHZ 8SOIC |
| 24AA08T-I/MNY | IC EEPROM 8KBIT 400KHZ 8TDFN |
| HMC35DRYI-S13 | CONN EDGECARD 70POS .100 EXTEND |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| DS3166 | 制造商:Maxim Integrated Products 功能描述:6 PORT ATM/PHY 676-TEPBGA - Trays |
| DS3166N | 制造商:Maxim Integrated Products 功能描述:6 PORT ATM/PHY 676-TEPBGA IND - Trays |
| DS3168 | 制造商:Maxim Integrated Products 功能描述:8 PORT ATM/PHY 676-TEBGA - Trays |
| DS3168N | 制造商:Maxim Integrated Products 功能描述:8 PORT ATM/PHY 676-TEPBGA IND - Trays |
| DS316CC-F8 | 制造商:Enhance Technology 功能描述:ULTRASTOR DS SPARE PART: ONE (1) 6G SAS JBOD CONTROLLER KIT - Bulk |
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