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參數(shù)資料
| 型號： | DS3164N |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 265/384頁 |
| 文件大小： | 0K |
| 描述： | IC QUAD ATM/PACKET PHY 400-PBGA |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 1 |
| 類型： | PHY 收發(fā)器 |
| 應用： | 測試設備 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 400-BBGA |
| 供應商設備封裝： | 400-PBGA（27x27） |
| 包裝： | 托盤 |
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DS3161/DS3162/DS3163/DS3164
Register Name:
CP.RSR
Register Description:
Cell Processor Receive Status Register
Register Address:
(1,3,5,7)CEh
Bit #
15
14
13
12
11
10
9
8
Name
--
OOS
--
OCD
LCD
Bit #
7
6
5
4
3
2
1
0
Name
--
RECC
RHPC
RCHC
Bit 11: Out Of Sync (OOS) – This read only bit indicates that a DSS Out Of Sync (OOS) state exists. DSS OOS
occurs when the DSS Scrambler Synchronization state machine is in the "Load" or "Verify" state, and DSS
scrambling has been enabled.
Bit 9: Out Of Cell Delineation (OCD) – This read only bit indicates that an Out of Cell Delineation condition (OCD)
exists. When DSS scrambling is disabled, OCD occurs when the HEC Error Monitoring state machine is in the
"OCD" state. When DSS scrambling is enable, OCD occurs when the DSS OCD Detection state machine is in the
"OCD" state.
Bit 8: Loss Of Cell Delineation (LCD) – This read only bit indicate that a Loss of Cell Delineation state exists.
LCD occurs when OCD persists for the period programmed in the LCD threshold control register RLTC.
Bit 2: Receive Errored Header Cell Count (RECC) – This read only bit indicates that the receive errored header
cell count is non-zero.
Bit 1: Receive Header Pattern Cell Count (RHPC) – This read only bit indicates that the receive header pattern
comparison cell count is non-zero.
Bit 0: Receive Corrected Cell Count (RCHC) – This read only bit indicates that the receive corrected header cell
count is non-zero.
Register Name:
CP.RSRL
Register Description:
Cell Processor Receive Status Register Latched
Register Address:
(1,3,5,7)D0h
Bit #
15
14
13
12
11
10
9
8
Name
--
OOSL
COCDL
OCDCL
LCDCL
Bit #
7
6
5
4
3
2
1
0
Name
RECL
RCHL
RIDL
RUDL
RIVDL
RECCL
RHPCL
RCHCL
Bit 11: Out Of Sync Change Latched (OOSL) – This bit is set when the OOS bit in the CP.RSR register changes
state.
Bit 10: Change Of Cell Delineation Latched (COCDL) – This bit is set when the data path cell counters are
updated with a new cell delineation that is different from the previous cell delineation
Bit 9: Out Of Cell Delineation Change Latched (OCDCL) –.This bit is set when the OCD bit in the CP.RSR
register changes state. Note: Immediately after a reset, this bit will be set to one.
Bit 8: Loss Of Cell Delineation Change Latched (LCDCL) – This bit is set when the LCD bit in the CP.RSR
register changes state
Bit 7: Receive Errored Header Cell Latched (RECL) – This bit is set when a cell with an errored header is
discarded.
Bit 6: Receive Corrected Header Cell Latched (RCHL) – This bit is set when a cell with a single header error is
corrected.
相關PDF資料 |
PDF描述 |
|---|---|
| AMC22DRYN-S93 | CONN EDGECARD 44POS DIP .100 SLD |
| AMC22DRYH-S93 | CONN EDGECARD 44POS DIP .100 SLD |
| 24LC00-I/SN | IC EEPROM 128BIT 400KHZ 8SOIC |
| 24AA08T-I/MNY | IC EEPROM 8KBIT 400KHZ 8TDFN |
| HMC35DRYI-S13 | CONN EDGECARD 70POS .100 EXTEND |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| DS3166 | 制造商:Maxim Integrated Products 功能描述:6 PORT ATM/PHY 676-TEPBGA - Trays |
| DS3166N | 制造商:Maxim Integrated Products 功能描述:6 PORT ATM/PHY 676-TEPBGA IND - Trays |
| DS3168 | 制造商:Maxim Integrated Products 功能描述:8 PORT ATM/PHY 676-TEBGA - Trays |
| DS3168N | 制造商:Maxim Integrated Products 功能描述:8 PORT ATM/PHY 676-TEPBGA IND - Trays |
| DS316CC-F8 | 制造商:Enhance Technology 功能描述:ULTRASTOR DS SPARE PART: ONE (1) 6G SAS JBOD CONTROLLER KIT - Bulk |
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