參數(shù)資料
型號(hào)： DS3164N
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 10/384頁(yè)
文件大小： 0K
描述： IC QUAD ATM/PACKET PHY 400-PBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 1
類(lèi)型： PHY 收發(fā)器
應(yīng)用： 測(cè)試設(shè)備
安裝類(lèi)型： 表面貼裝
封裝/外殼： 400-BBGA
供應(yīng)商設(shè)備封裝： 400-PBGA（27x27）
包裝： 托盤(pán)
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DS3161/DS3162/DS3163/DS3164
Table 10-9. CLAD IO Pin Decode
CLAD[3:0]
CLKA PIN
CLKB PIN
CLKC PIN
00 XX
DS3 clock input
E3 clock input
STS-1 clock input
01 00
DS3 clock input
Low output
01 01
DS3 clock input
E3 clock output
Low output
01 10
DS3 clock input
Low output
STS-1 clock output
01 11
DS3 clock input
STS-1 clock output
E3 clock output
10 00
E3 clock input
Low output
10 01
E3 clock input
DS3 clock output
Low output
10 10
E3 clock input
Low output
STS-1 clock output
10 11
E3 clock input
STS-1 clock output
DS3 clock output
11 00
STS-1 clock input
Low output
11 01
STS-1 clock input
E3 output
Low output
11 10
STS-1 clock input
Low output
DS3 clock output
11 11
STS-1 clock input
DS3 clock output
E3 clock output
10.4.2 8 kHz Reference Generation
The 8KREF signal is used to control the rate of PLCP frames to precisely 8000 per second. The global 8KREF
signal is also used to generate the one-second reference signal by dividing it by 8000. This signal can be derived
from almost any clock source on the chip as well as the general-purpose I/O pin GPIO4. The port 8KREF signal
can be sourced from either the global 8KREF signal or from the transmit or receive port clock or from the receive
8KREF signal. The minimum input frequency stability of the 8KREF input pin is ±500 ppm.
The global 8KREF signal can come from an external 8000 Hz reference connected to the GPIO4 general-purpose
I/O pin by setting the GL.CR2.G8KIS bit. The global 8KREF signal can be output on the GPIO2 general-purpose
I.O pin when the GL.CR2.G8KOS bit is set.
The global 8KREF signal can be derived from the CLAD PLL or pins or come from any of the port 8KREF signals
by clearing GL.CR2.G8KIS bit and selecting the source using the GL.CR2.G8KRS[2:0] bits.
The port 8KREF signal can be derived from either the receive PLCP 8KREF signal or from the transmit clock input
pin or input clock pin. The PORT.CR3.P8KRS[1:0] bits are used to select which source.
The transmit PLCP 8KREF signal can be selected to be either the global 8KREF signal or the port 8KREF signal
using the PORT.CR3.P8KREF bit.
The 8KREF 8.000 kHz signal is a simple divisor of 51840 kHz (CC52 divided by 6480), 44736 kHz (DS3 divided by
5592) or 33368 kHz (E3 divided by 4296). The correct divisor for the port 8KREF source is selected by the mode
the port is configured for. The CLAD clock chosen for the clock source selects the correct divisor for the global
8KREF. The 8KREF signal is only as accurate as the clock source chosen to generate it.
Table 10-10 lists the selectable sources for global 8 kHz reference sources.
相關(guān)PDF資料
PDF描述
AMC22DRYN-S93 CONN EDGECARD 44POS DIP .100 SLD
AMC22DRYH-S93 CONN EDGECARD 44POS DIP .100 SLD
24LC00-I/SN IC EEPROM 128BIT 400KHZ 8SOIC
24AA08T-I/MNY IC EEPROM 8KBIT 400KHZ 8TDFN
HMC35DRYI-S13 CONN EDGECARD 70POS .100 EXTEND
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
DS3166 制造商:Maxim Integrated Products 功能描述:6 PORT ATM/PHY 676-TEPBGA - Trays
DS3166N 制造商:Maxim Integrated Products 功能描述:6 PORT ATM/PHY 676-TEPBGA IND - Trays
DS3168 制造商:Maxim Integrated Products 功能描述:8 PORT ATM/PHY 676-TEBGA - Trays
DS3168N 制造商:Maxim Integrated Products 功能描述:8 PORT ATM/PHY 676-TEPBGA IND - Trays
DS316CC-F8 制造商:Enhance Technology 功能描述:ULTRASTOR DS SPARE PART: ONE (1) 6G SAS JBOD CONTROLLER KIT - Bulk
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