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參數(shù)資料
| 型號： | DS3164N |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 204/384頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC QUAD ATM/PACKET PHY 400-PBGA |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 1 |
| 類型： | PHY 收發(fā)器 |
| 應用： | 測試設(shè)備 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 400-BBGA |
| 供應商設(shè)備封裝： | 400-PBGA（27x27） |
| 包裝： | 托盤 |
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DS3161/DS3162/DS3163/DS3164
12.10.4 Receive G.751 E3 Register Map
The receive G.751 E3 utilizes eight registers.
Table 12-36. Receive G.751 E3 Framer Register Map
Address
Register
Register Description
(1,3,5,7)20h
E3G751.RCR
E3 G.751 Receive Control Register
(1,3,5,7)22h
--
Reserved
(1,3,5,7)24h
E3G751.RSR1
E3 G.751 Receive Status Register #1
(1,3,5,7)26h
E3G751.RSR2
E3 G.751 Receive Status Register #2
(1,3,5,7)28h
E3G751.RSRL1 E3 G.751 Receive Status Register Latched #1
(1,3,5,7)2Ah
E3G751.RSRL2 E3 G.751 Receive Status Register Latched #2
(1,3,5,7)2Ch
E3G751.RSRIE1 E3 G.751 Receive Status Register Interrupt Enable #1
(1,3,5,7)2Eh
E3G751.RSRIE2 E3 G.751 Receive Status Register Interrupt Enable #2
(1,3,5,7)30h
--
Reserved
(1,3,5,7)32h
--
Reserved
(1,3,5,7)34h
E3G751.RFECR E3 G.751 Receive Framing Error Count Register
(1,3,5,7)36h
--
Reserved
(1,3,5,7)38h
--
Reserved
(1,3,5,7)3Ah
--
Reserved
(1,3,5,7)3Ch
--
Unused
(1,3,5,7)3Eh
--
Unused
12.10.4.1 Register Bit Descriptions
Register Name:
E3G751.RCR
Register Description:
E3 G.751 Receive Control Register
Register Address:
(1,3,5,7)20h
Bit #
15
14
13
12
11
10
9
8
Name
Reserved
DLS
MDAISI
AAISD
ECC
FECC1
FECC0
Default
0
Bit #
7
6
5
4
3
2
1
0
Name
RAILE
RAILD
RAIOD
RAIAD
ROMD
LIP1
LIP0
FRSYNC
Default
0
Bit 13: Receive FEAC Data Link Source (DLS) – When 0, the receive FEAC controller will be sourced from the N
bit. When 1, the receive FEAC controller will be sourced from the A bit.
Bit 12: Manual Downstream AIS Insertion (MDAISI) – When 0, manual downstream AIS insertion is disabled.
When 1, manual downstream AIS insertion is enabled.
Bit 11: Automatic Downstream AIS Disable (AAISD) – When 0, the presence of an LOS, OOF, or AIS condition
will cause downstream AIS to be inserted. When 1, the presence of an LOS, OOF, or AIS condition will not cause
downstream AIS to be inserted.
Bit 10: Error Count Control (ECC) – When 0, framing errors will not be counted if an OOF or AIS condition is
present. When 1, framing errors will be counted regardless of the presence of an OOF or AIS condition.
Bits 9 to 8: Framing Error Count Control (FECC[1:0]) – These two bits control the type of framing error events
that are counted.
00 = count OOF occurrences (counted regardless of the setting of the ECC bit)..
01 = count each bit error in the FAS (up to 10 per frame).
10 = count frame alignment signal (FAS) errors (up to one per frame).
11 = reserved
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AMC22DRYN-S93 | CONN EDGECARD 44POS DIP .100 SLD |
| AMC22DRYH-S93 | CONN EDGECARD 44POS DIP .100 SLD |
| 24LC00-I/SN | IC EEPROM 128BIT 400KHZ 8SOIC |
| 24AA08T-I/MNY | IC EEPROM 8KBIT 400KHZ 8TDFN |
| HMC35DRYI-S13 | CONN EDGECARD 70POS .100 EXTEND |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DS3166 | 制造商:Maxim Integrated Products 功能描述:6 PORT ATM/PHY 676-TEPBGA - Trays |
| DS3166N | 制造商:Maxim Integrated Products 功能描述:6 PORT ATM/PHY 676-TEPBGA IND - Trays |
| DS3168 | 制造商:Maxim Integrated Products 功能描述:8 PORT ATM/PHY 676-TEBGA - Trays |
| DS3168N | 制造商:Maxim Integrated Products 功能描述:8 PORT ATM/PHY 676-TEPBGA IND - Trays |
| DS316CC-F8 | 制造商:Enhance Technology 功能描述:ULTRASTOR DS SPARE PART: ONE (1) 6G SAS JBOD CONTROLLER KIT - Bulk |
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